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히스테리시스가 디지털로 제어되는 CMOS 비교기 IC 회로
A Digitally Controllable Hysteresis CMOS Monolithic Comparator Circuit 원문보기

電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체, v.47 no.11 = no.401, 2010년, pp.37 - 42  

김영기 (안양대학교)

초록
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본 논문에서는 주변의 간섭 잡음의 변화가 큰 RFID 환경에서 입력 신호를 구형파로 복원할 때 히스테리시스의 문턱전압을 디지털적으로 제어하여 신호 수신 신뢰도를 높이기 위한 비교기 회로를 0.35 마이크론 선폭의 CMOS IC 로 제안 하고 분석, 설계 후 제작하여 전기적 특성을 측정, 비교, 분석하였다. 이론에서 예측한 디지털 제어 비트의 변화에 대한 히스테리시스의 문턱전압의 가변성이 실험에서 잘 일치함을 입증하였다.

Abstract ▼ AI-Helper 아이콘AI-Helper

A novel hysteresis tunable monolithic comparator circuit based on a $0.35{\mu}m$ CMOS process is suggested, designed, fabricated, measured and analyzed in this paper. To tune the threshold voltage of the hysteresis in the comparator circuit, two external digital bits are used with supply ...

주제어

#비교기   #히스테리시스   #알에프아이디 (스타일:Keywords내용)  

AI 본문요약
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문제 정의

  • 본 논문에서는 히스테리시스의 문턱 전압을 안정된 디지털방식의 두개의 비트로 조절 할 수 있는 비교기회로를 CMOS 회로로 제안한다.
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질의응답

핵심어 질문 논문에서 추출한 답변
트랜지스터 M3, M4, M6, M7에 흐르는 전류의 비의 값이 1보다 커지면 어떠한 현상이 일어나는가? 그림 2는 히스테리시스를 갖는 일반적인 비교기회로 도이며 트랜지스터 M3, M4, M6, M7 에 흐르는 전류의 비 ID6/ID3와 ID7/ID4의 값이 1 보다 작으면 음의 피드백이 되어 히스테리시스가 없다. 반면에 그 비율 값이 1보다 커지면 양의 피드백이 형성되고 히스테리시스가 시작된다.
히스테리시스의 문턱전압을 낮추기 위해 어떠한 구조의 회로가 제안되었는가? 히스테리시스의 문턱전압을 낮추기 위한 BICMOS 구조의 회로가 제안 되었으며[2], 히스테리시스의 문턱전압을 제어하기 위하여 단지 시뮬레이션 결과만으로 MUX, D-플립플롭등 비교적 복잡하고 검증 되지 않는 회로들을 이용하여 전류를 제어함으로서 히스테리시스를 제어하는 CMOS IC 회로가 제안 되었다[3].
RFID가 보편화됨에 따라 어떠한 연구가 진행되었는가? RFID가 보편 화 됨에 따라 인접한 다른 무선 통신 기기 및 주변으로 부터의 간섭 잡음에 의한 영향으로 통신 신뢰도가 저하 되는 것을 막기 위한 연구가 진행되어 왔다[1].
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참고문헌 (4)

  1. K. Udo and F. Martin, "Fully Integrated Passive UHF RFID Transponder IC With 16.7-W Minimum RF Input Power," IEEE JOURNAL OF SOLID-STATE CIRCUITS, NO. 10, VOL. 38, pp. 1602-1608, October 2003. 

    상세보기 crossref

  2. G. Xiaofeng, L. Xinquan, L. Yushan, W. Jianping Z. Jie, "Design and application of the novel low-threshold comparator using hysteresis," in Proc. of 6th International Conference On ASIC Proceedings, pp. 549-553, Shanghai, China, October 2005. 

  3. H. W. Huang, C. H. Lin, K, H, Chen, " A programmable dual hysteretic window comparator," in Proc. of IEEE International Symposium on Circuits and Systems 2008, pp. 1930-1933, Seattle, U. S. A, May 2008. 

  4. P. E. Allen and D. R. Holberg, "CMOS Analog Circuit Design." 2nd Edition,Oxford University Press. 2002. 

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