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영상 프레임 디코딩 복잡도 예측을 통한 DVFS 전력감소 방식
Power-Minimizing DVFS Algorithm Using Estimation of Video Frame Decoding Complexity 원문보기

한국통신학회논문지. The Journal of Korea Information and Communications Society. 네트워크 및 서비스, v.38B no.1, 2013년, pp.46 - 53  

안희준 (서울과학기술대학교 전기정보시스템공학과) ,  정승호 ((주) 윈포넷)

초록
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최근 영상 디코더 시스템에서 소모전력을 절감하기 위한 방안으로 DVFS (Dynamic Voltage and Frequency Scaling) 방식을 적용한 알고리즘 들이 제안되고 있다. 이에 저자들은 논문[1]에서 전력소모를 최소화할 수 있는 스케줄링 알고리즘을 제시하였다. 이 알고리즘은 수학적으로 최적의 결과를 보장하지만, 사전에 화면 당 디코딩 계산양을 알 수 있다는 조건이 만족하여야 한다. 그러나 실제응용에서 이 조건은 만족되기 어려운 경우가 종종 존재한다. 본 논문에서는 이 제약사항을 극복하는 방안으로, 프레임의 데이터크기로 프레임의 디코딩 계산양을 예측하는 기법에 기초한 수정된 알고리즘을 제안한다. 실제 영상에서 추출된 데이터를 이용한 결과, 계산양 예측 알고리즘은 평균적으로 90%이상의 정확도를 보였으며, 따라서 계산양 예측 기법과 임계점에서의 프래임 크기 20% 내외의 완충버퍼 마진을 적용한 수정한 알고리즘은 버퍼 고갈과 넘침이 일어나지 않으며, 최적알고리즘과 비교할 때 거의 동일한 성능 (1~2% 이하의 성능저하)을 보이는 것을 확인하였다.

Abstract AI-Helper 아이콘AI-Helper

Recently, intensive research has been performed for reducing video decoder energy consumption, especially based on DVFS (Dynamic Voltage and Frequency Scaling) technique. Our previous work [1] has proposed the optimal DVFS algorithm for energy reduction in video decoders. In spite of the mathematica...

주제어

AI 본문요약
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문제 정의

  • 본 논문에서 저자들은 논문[1]에서 제안하고 증명한 최소 전력소모 DVFS 스케쥴링 알고리즘을 화면당 계산 복잡도를 알지 못하는 (실시간) 상황으로 확장하기 위한 방안과 알고리즘을 제시하였다. 프레임당 디코딩 양과 계산 복잡도가 상관도가 높다는 사실을 이용하였다.
  • 이 알고리즘은 수학적으로 최적의 결과를 가져오지만, 사전에 정확한 화면당 디코딩 계산양을 알고 있다는 조건을 만족하여야 하는데, 이는 디코더의 응용에 따라 만족되기 어려운 경우가 존재한다. 본 논문에서는 프레임의 데이터크기로 프레임의 디코딩 계산양을 예측하는 알고리즘을 활용하여, 이제약사항을 극복하는 알고리즘을 제안한다. 이 아이디어의 근간에는 상당 수준이상의 정확도가 보장된 계산양 예측 알고리즘을 고안하게 된다면 이를 기반으로 최적알고리즘을 적용하였을 때 약간의 완충 버퍼를 사용하면 버퍼 고갈과 넘침이 일어나지 않고, 기존의 최적 DVFS 알고리즘의 성능을 확보할 수 있을 것이라는 점이다.
  • 본 논문은 이와 같은 아이디어를 만족하는 구체적인 동작 알고리즘을 구성하고 실제 데이터를 사용하여 실용성을 검증하는 것이 목적이며, 이에 따라 다음과 같이 구성하였다..

가설 설정

  • 에서 제안한 방식으로 성능을 보장하면서 디스플레이 버퍼를 이용해 DVFS 스케줄링을 한다. 실시간성을 보장하기 위해 시뮬레이션에선 최악의 경우 디코딩 시간을 알고 있다고 가정한다. 각 프레임 별로 식 (12)와 같이 주파수 스케일링 계수를 구해서 k번째 프레임을 디코딩 할 때, fmax × rk 로 CPU 클럭을 할당한다.
  • 예를 들어 연구 [4]에서 저자들은 동영상의 화면 당 계산 양 히스토그램에 기초하여 일정 수준의 QoS를 만족하고, 한 프레임을 디코딩하면서 CPU 클럭을 조절하는 알고리즘을 제안하였다. 즉, 이 일련의 연구들은 디코더의 영상입력시점과 출력시점의 간격이 고정되어있다고 가정하였으며, 따라서 일반적으로 영상 디코더 시스템에서 사용할 수 있는 디코더와 디스플레이 사이에 버퍼를 적절히 활용하지 못했다. 연구 [4,5]에서는 이러한 디스플레이 버퍼의 사용을 활용하면 DVFS를 통해 더 많은 에너지 절감을 달성할 수 있음을 보였다.
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질의응답

핵심어 질문 논문에서 추출한 답변
노트북, PMP, 스마트폰 등 휴대, 모바일 장치는 무엇을 에너지원으로 사용하고 있는가? 저 전력 시스템 설계 기술은 최근 컴퓨터 시스템이 당면한 가장 중요한 문제 중의 하나이다[2]. 특히, 노트북, PMP, 스마트폰 등 휴대, 모바일 장치는 배터리를 에너지원으로 사용하고 있으며, 점차로 이러한 모바일 장치에서 동영상 소비가 증가하고 있다. 따라서 영상 디코더시스템의 저전력화 기법은 실용적인 측면에서 중요성이 매우 높다.
영상디코더의 태스크의 정의는 무엇인가? 영상 디코더의 DVFS 알고리즘을 이해하기 위해서는 다음과 같은 사항의 이해가 필요하다. 영상디코더의 태스크는 한 영상화면(프레임)의 디코딩으로 정의하는데, 일정한 시간간격으로 화면에 출력되기 위하여 데드라인(deadline)을 만족하여야 하므로 실시간 시스템의 특성을 갖는다. 그러나 영상 프레임의 디코딩 시간의 가변적인 특성과 절대적 데드라인 시간이아니라 상대적인 시간간격이 중요하다.
영상디코더는 영상 프레임의 디코딩 시간의 가변적인 특성과 절대적 데드라인 시간이 아니라 상대적인 시간 간격이 중요한데, 이러한 차이점을 고려하여 어떠한 알고리즘이 제안되었는가? 그러나 영상 프레임의 디코딩 시간의 가변적인 특성과 절대적 데드라인 시간이아니라 상대적인 시간간격이 중요하다. 이러한 차이점을 고려하여 영상디코더에 특화된 DVFS 알고리즘들이 제안되었다[3-9]. 기존의 대부분의 연구, [4,7-9] 등은 모두 한 프레임 간격 동안 프레임의 디코딩을 진행하여야하는 데드라인 조건을 가정하고 있다.
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참고문헌 (13)

  1. S. Jeong, and H. Ahn, "Power-minimizing DVFS algorithm for a video decoder with buffer constraints," J. KICS, vol. 36, no. 9, pp. 1082-1091, Sep. 2011. 

  2. O. S. Unsal and I. Koren, "System-level power-aware design techniques in real-time systems," Proc. of IEEE vol. 91, no. 71, pp. 1055-1069, Jul. 2003. 

  3. W. Yuan, and K. Nahrstedt, "Practical voltage scaling for mobile multimedia devices," in Proc. ACM Multimedia'04, pp. 924-931, New York, Oct. 2004. 

  4. C. Im, H. Kim, and S. Ha. "Dynamic voltage scheduling technique for low-power multimedia applications using buffers," in Proc. Int. Symp. on Low Power Elec. and Design, pp. 34-39, Aug. 2001. 

  5. Z. Lu, J. Lach, M. Stan, and K. Skadron, "Reducing multimedia decode power using feedback control," in Proc. Int. Conf. on Computer Design, pp. 489-796, Oct., 2003. 

  6. M. Mesarina and Y. Turner, "Reduced energy decoding of MPEG streams," in proc. ACM/SPIE Multimedia Comp. and Netw, 2002 (MMCN'02), pp. 202-213, Jan. 2002. 

  7. J. Pouwelse, K. Langendoen, R. Lagendijk, and H. Sips, "Power-aware video decoding," in proc. Picture Coding Symposium (PCS '01), pp. 303-306, Apr. 2001. 

  8. D. Son, C. Yu, and H. Kim, "Dynamic voltage scaling on MPEG decoding," in proc. Int'l Conf. of Parallel and Dist. Sys., pp. 633-640, Jun. 2001. 

  9. E. Nurvitadhi, B. Lee, C. Yu, and M. Kim, "A comparative study of dynamic voltage scaling techniques for low-power video decoding," in proc. Int. Conf. Embed. Syst. and App., pp. 23-26, Jun. 2003. 

  10. A. C. Bavier, A. B. Montz, Larry and L. Peterson, "Predicting MPEG execution times," in proc. SIGMETRICS'98/PERFORMANCE '98 pp.131-140, Jun. 1998. 

  11. ffmeg, from www.ffmpeg.org. 

  12. B. Case, ''Intel reveals pentium implementation details," Microprocessor Report, pp. 9-13, Mar. 29, 1993. 

  13. x264, from http://www.videolan.org/ developers/ x264.html 

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