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문제 정의
- 하지만, 고속화 알고리즘으로 얻을 수 있는 속도 향상만으로는 HEVC 인코더의 실시간성 확보에 어려움이 있다. 본 논문에서는 HEVC 인코더의 높은 복잡도를 감소시키고, 실시간성 확보를 위하여 SIMD (single instruction multiple data) 명령어를 이용한 데이터 수준의 병렬화 (DLP: data level parallelism) 기법, CPU 및 GPU를 이용한 멀티스레딩 (multi threading) 기법과 같은 다양한 병렬화 기법을 소개하고, 이를 적용하기 적합한 연산 및 모듈에 대하여 소개한다.
- 본 논문에서는 소개한 SIMD 명령어를 사용한 다양한 연산 및 기능 모듈에 대한 DLP와 CPU 및 GPU 멀티스레딩 기법을 적용한 병렬처리를 통하여 HEVC 인코더의 부호화 속도를 향상시켰다. 연산 및 기능 모듈 관점에서는 SIMD 명령어를 사용하여 cost 함수, 변환 및 역-변환, 보간 필터에 DLP를 적용하였다.
- 본 논문에서는 소프트웨어 기반 실시간 HEVC 인코더 구현을 위하여 다양한 병렬화 기법에 대하여 소개하고, 이를 적용하기 용이한 연산 및 기능 모듈을 소개하였다. 서로 다른 데이터에 대한 동일한 연산을 반복적으로 수행하는 cost 함수, 변환 및 역-변환, 보간 필터에 SIMD 명령어를 적용하여 DLP를 수행하였다.
- SIMD 명령어를 이용한 데이터 수준 병렬화 기법을 적용하기 적합한 HEVC 인코더의 단일 연산 혹은 기능 모듈을 살펴보면, 율-왜곡 값을 계산하기 위한 cost 함수, 변환 (transform) 및 역-변환 (inverse-transform), 움직임 정밀도를 높이기 위한 화소 보간 필터 (interpolation filter)를 꼽을 수 있다. 본 장에서는 전술한 연산 및 기능 모듈에 SIMD를 적용하기 적합한 이유를 살펴보고 적용 방법에 대하여 살펴보도록 한다.
- HEVC의 DCT-IF는 tap 계수와 함께 산술 연산 및 메모리 참조가 증가하여 HEVC 인코더 복잡도 또한 크게 증가하였다[10]. 하지만, 전술한 보간 필터와 같은 필터 연산의 경우 SIMD 명령어를 사용하여 DLP를 적용하기 적합한 구조이며, 본 논문에서는 보간 필터의 연산 복잡도를 낮추기 위하여 다음과 같은 과정을 수행하였다.
제안 방법
- GPU 멀티스레딩 기법의 속도향상을 측정하기 위해 정수 화소 움직임 예측 모듈의 수행시간을 측정하였다. GPU 기반 움직임 예측이 프레임 단위로 수행됨으로 anchor에 해당하는 HM 10.0의 정수화소 움직임 예측 방법의 수행시간도 프레임 단위로 측정하였다. GPU 기반 움직임 예측의 수행시간에는 CPU와 GPU 간의 통신시간을 포함시켰다.
- GPU 멀티스레딩 기법의 속도향상을 측정하기 위해 정수 화소 움직임 예측 모듈의 수행시간을 측정하였다. GPU 기반 움직임 예측이 프레임 단위로 수행됨으로 anchor에 해당하는 HM 10.
- HEVC 인코더의 부호화 속도 측정을 위하여, HEVC 참조 소프트웨어인 HM 10.0을 기반으로 C 변환 및 최적화를 수행한 소프트웨어에 SIMD 명령어, OpenMP 기반 CPU 멀티스레딩, CUDA 기반 GPU 멀티스레딩 병렬화 기법을 적용하였다.
- 264/AVC의 압축효율을 2배 이상 향상시키는 것을 목표로 새로운 비디오 압축 표준인 HEVC (high efficiency video coding)에 대한 표준화를 진행하였다[1][2]. HEVC는 종래의 비디오 압축 표준과 마찬가지로 블록 기반의 하이브리드 코딩에 기반하고 있으나, 추가적인 신규 기술들을 적용 하여 H.264/AVC, MPEG-2, 4에서 사용된 매크로 블록의 개념에 CU (coding unit), PU (prediction unit), TU (transform unit)의 세분화된 부호화 단위를 적용하여 압축 효율을 향상시켰다. 현재, HEVC는 64×64 블록 크기부터, 32×32, 16×16, 8×8에 이르는 블록 크기의 CU 단위 부호화를 수행한다.
- HM 소프트웨어를 기반으로 슬라이스와 타일별로 스레드를 할당하기 위하여 OpenMP를 사용하였으며, 병렬 부호화에 필요한 다양한 클래스 인스턴스들을 스레드 개수에 맞춰 생성하여 슬라이스와 타일 단위 병렬화를 수행하였다.
- 연산 및 기능 모듈 관점에서는 SIMD 명령어를 사용하여 cost 함수, 변환 및 역-변환, 보간 필터에 DLP를 적용하였다. 또한, CUDA를 이용한 움직임 예측 및 모드 결정에 GPU 멀티스레딩 기법을 적용하였다. 부호화 구조 관점에서는 OpenMP를 이용한 슬라이스 및 타일 병렬처리를 수행하여 CPU 멀티스레딩 기법을 적용하였다.
- 또한, OpenMP를 이용한 CPU 멀티스레딩 기법을 통해 슬라이스및 타일 단위 병렬처리를 수행하였으며, CUDA를 이용한 GPU 멀티스레딩 기법을 통해 움직임 예측 및 모드 결정에 대한 병렬처리를 수행하였다.
- 부호화 속도의 측정은 PC 환경에서의 프로그램 동작 시간을 초단위로 측정하였으며, 초당 영상 프레임 처리 수 (FPS : frames per second)를 계산 하였다. 또한, 각 병렬화 기법을 적용하여 향상된 속도의 측정은 수식 (1)의 ATS (average time saving)을 사용하여 제시한다. Etimeanchor는 병렬화를 적용하기 이전의 부호화 시간을 의미하며, Etimeproposed는 본 논문에서 제안하는 병렬화를 적용한 이후의 부호화 시간을 의미한다.
- 탐색 방법은 전역탐색 (full-search)를 사용하고, 작은 PU들의 SAD를 더하여 더 큰 PU의 SAD를 도출해 내는 계층적 SAD 계산 (hierarchical SAD computing)과 여러 율-왜곡값 중에서 최솟값을 찾기 위한 CPR (concurrent parallel reduction) 알고리듬을 적용하였다[15]. 또한, 보다 정밀한 움직임 예측을 위해 참조 프레임에 대한 보간 필터 수행과[16] 분수 화소 단위 움직임 예측도 GPU에서 수행하였다. GPU에서 보간 필터를 수행함으로써 알고리듬 고속화와 CPU와의 통신을 최소화할 수 있었다.
- 또한, 참조 픽쳐의 수는 1개로 고정하였으며, 최대 CTU 크기는 32×32 를 사용하여 부호화를 수행하였다.
- 변환 및 역-변환에 대해 SIMD 명령어를 적용함에 있어서 본 논문에서는 순차적인 산술 연산에 유리한 행렬 곱 형태를 사용하여 나타낸다. 그림 3은 4×4 역-변환에 대한 SIMD 명령어 적용을 나타낸다.
- 본 논문에서는 4×4 블록에서 64×64 블록에 대한 SAD, SSE 연산과 4×4, 8×8 SATD 연산을 SIMD 명령어를 사용하여 구현하였다.
- 전술한 다양한 병렬화 기법을 적용하여 HEVC 인코더의 부호화 속도를 832×480 영상의 경우 10~30fps, 1920×1080 영상의 경우 5~10fps로 향상시킬 수있었다. 본 논문에서는 SIMD 명령어를 이용한 DLP를 cost 함수, 변환 및 역-변환, 보간 필터에 적용하였으나, 이외에도 화면 내 예측 수행과정에서의 참조샘플 필터 연산, 복원 영상 생성 등 SIMD 명령어를 적용할 수 있는 연산 및 모듈이 존재한다. 또한, CPU 및 GPU 멀티스레딩 기법의 병렬 처리 속도 향상을 위하여 고속화 알고리즘 연구가 필요할 것으로 예상된다.
- 본 논문에서는 그림 6과 같이 슬라이스와 타일 단위 병렬 처리를 위해 하나의 프레임을 슬라이스와 타일로 분할하고, 분할된 슬라이스와 타일별로 스레드를 할당하였다. 그림 6 은 슬라이스와 타일의 병렬처리에 따른 스레드 할당 및 부호화 순서이며, 각 스레드는 해당 슬라이스와 타일에 포함된 CTU를 Z-스캔 순서에 따라 병렬적으로 부호화를 수행 한다.
- 하지만, 다양한 크기의 변환 커널의 지원과 쿼드-트리구조의 TU의 사용으로 인하여 연산 복잡도는 크게 증가하였다. 본 논문에서는 변환 및 역-변환에 대하여 SIMD 명령어를 적용하여 연산 복잡도를 감소시킬 수 있었다.
- 0을 기반으로 C 변환 및 최적화를 수행한 소프트웨어에 SIMD 명령어, OpenMP 기반 CPU 멀티스레딩, CUDA 기반 GPU 멀티스레딩 병렬화 기법을 적용하였다. 본 연구에서 제안하는 병렬화 기법들을 적용한 HEVC 인코더의 부호화 속도를 측정하기 위하여 표 2의 실험 환경에서 HEVC 공통 실험 조건[17] 에 따라 소프트웨어를 동작시켰다. 부호화 속도의 측정은 PC 환경에서의 프로그램 동작 시간을 초단위로 측정하였으며, 초당 영상 프레임 처리 수 (FPS : frames per second)를 계산 하였다.
- OpenMP는 CPU 환경의 다중 프로세싱을 지원하는 API로 포크-조인 (fork-join)모델에 기반하여 다양한 응용의 병렬처리에 사용되고 있다. 본 연구에서는 HEVC 인코더를 위한 CPU 멀티스레딩을 수행하기 위하여 OpenMP를 사용 하였다. 병렬화 기법을 적용하기에 앞서, 적용하고자 하는 병렬화 기법의 선택을 위한 부호화 속도 개선, 부호화 성능, 코어의 확장성 등의 여러 요인들에 대한 고려가 필요하다.
- 본 연구에서는 HEVC 인코더에서 GPU 적용이 가능한 다양한 연산 중 움직임 예측, 보간 필터 및 블록 분할 결정에 적용하여 병렬화를 수행하였다. 이 움직임 예측 방법은 현재 프레임 내에 존재하는 모든 가능한 PU들의 움직임 벡터를 획득한다.
- HEVC는 다양한 부호화 블록 크기에 대한 재귀적 모드 결정 방법으로 연산 복잡도가 크게 증가하였다. 본 연구에서는 본 절에서 설명한 GPU 기반 움직임 예측을 통해 얻은 정보를 이용하여 GPU에서 블록 분할 결정을 수행하고, 최적 블록 분할에 대한 정보를 CPU로 전송한다. 이를 통해 CPU상에서 수행하는 RDO 과정에 대한 부하를 줄여 부호화 속도를 향상시켰다.
- 본 장에서는 다양한 병렬화 기법을 적용한 HEVC 인코더의 부호화 속도를 측정하고 이에 대하여 분석한다. HEVC 인코더의 부호화 속도 측정을 위하여, HEVC 참조 소프트웨어인 HM 10.
- 2장에서 소개한 SIMD 명령어를 통한 DLP와 더불어 비디오 코덱의 병렬처리를 위하여 널리 사용되고 있는 CPU 및 GPU를 이용한 멀티스레딩 기법은 SIMD 명령어보다 상위 수준의 병렬처리에 주로 사용된다. 본 장의 1절에서는 OpenMP를 이용한 CPU 멀티스레딩 기법을 슬라이스 및 타일 단위 병렬처리에 적용, 2절에서는 CUDA를 이용한 GPU 멀티스 레딩 기법을 프레임 단위 움직임 예측에 적용하고, GPU 기반 움직임 예측을 통해 획득한 정보를 이용하여 GPU에서 블록 분할 (block partition) 결정을 수행하여 최적의 모드를 고속으로 결정하였다.
- 또한, CUDA를 이용한 움직임 예측 및 모드 결정에 GPU 멀티스레딩 기법을 적용하였다. 부호화 구조 관점에서는 OpenMP를 이용한 슬라이스 및 타일 병렬처리를 수행하여 CPU 멀티스레딩 기법을 적용하였다. 전술한 병렬화 기법들을 종합하여 소프트웨어 기반 실시간 HEVC 인코더를 구현하여 측정한 부호화 속도는 표 5와 같다.
- 본 연구에서 제안하는 병렬화 기법들을 적용한 HEVC 인코더의 부호화 속도를 측정하기 위하여 표 2의 실험 환경에서 HEVC 공통 실험 조건[17] 에 따라 소프트웨어를 동작시켰다. 부호화 속도의 측정은 PC 환경에서의 프로그램 동작 시간을 초단위로 측정하였으며, 초당 영상 프레임 처리 수 (FPS : frames per second)를 계산 하였다. 또한, 각 병렬화 기법을 적용하여 향상된 속도의 측정은 수식 (1)의 ATS (average time saving)을 사용하여 제시한다.
- 본 논문에서는 소프트웨어 기반 실시간 HEVC 인코더 구현을 위하여 다양한 병렬화 기법에 대하여 소개하고, 이를 적용하기 용이한 연산 및 기능 모듈을 소개하였다. 서로 다른 데이터에 대한 동일한 연산을 반복적으로 수행하는 cost 함수, 변환 및 역-변환, 보간 필터에 SIMD 명령어를 적용하여 DLP를 수행하였다. SIMD 명령어를 이용한 DLP 를 적용하여 HEVC 인코더 소프트웨어의 부호화 속도를 부호화 효율의 저하 없이 약 2배 향상시킬 수 있었다.
- 본 논문에서는 소개한 SIMD 명령어를 사용한 다양한 연산 및 기능 모듈에 대한 DLP와 CPU 및 GPU 멀티스레딩 기법을 적용한 병렬처리를 통하여 HEVC 인코더의 부호화 속도를 향상시켰다. 연산 및 기능 모듈 관점에서는 SIMD 명령어를 사용하여 cost 함수, 변환 및 역-변환, 보간 필터에 DLP를 적용하였다. 또한, CUDA를 이용한 움직임 예측 및 모드 결정에 GPU 멀티스레딩 기법을 적용하였다.
- HM에서는 SATD 연산을 위해 butterfly 형태로 표현하였으며 2×2를 예로 그림 2와 같이 표현할 수 있다. 이러한 덧셈, 뺄셈 및 절댓값 연산에 대해 SIMD 명령어를 통해 최적화 하였다. SSE의 경우 원본 영상과 예측 영상과의 차분에 대한 제곱합을 구하는 함수이다.
- 본 연구에서는 본 절에서 설명한 GPU 기반 움직임 예측을 통해 얻은 정보를 이용하여 GPU에서 블록 분할 결정을 수행하고, 최적 블록 분할에 대한 정보를 CPU로 전송한다. 이를 통해 CPU상에서 수행하는 RDO 과정에 대한 부하를 줄여 부호화 속도를 향상시켰다. GPU는 움직임 예측을 통해 얻은 최적의 율-왜곡값을 기준으로 RDO 과정을 수행하여 각각의 CTU의 최적의 깊이, 움직임 벡터, 예측 블록을 생성한다.
- 수직 방향에 대해서는 8개의 데이터를 동시처리하기 위해 그림 5와 같이 64개의 정수 화소가 필요하며, 하나의 결과를 얻기 위해 수직방향으로 데이터를 로드하는 반면, 그림 5와 같은 구조의 경우 64개의 데이터를 수평방향으로 로드함에 따라 수직방향 로드에 대한 연산량이 감소하게 된다. 이와 같은 구조를 통해 각 데이터를 레지스터에 할당하여 PADDW 및 PMULLW 명령어를 사용하여 산술 연산을 수행하였다.
- 반면, 슬라이스와 타일은 모드 결정 및 예측, 엔트로피 부호화를 포함한 일련의 부호화 과정들을 인접한 슬라이스와 타일과 독립적으로 수행하기 때문에 병렬처리를 수행하는 슬라이스와 타일의 개수에 따라 부호화 성능에 영향을 받는다. 하지만, 본 연구에 서는 실시간 HEVC 부호화에 초점을 맞추었기 때문에, 병렬화에 따른 높은 속도 향상을 얻을 수 있는 슬라이스와 타일 단위 병렬화를 선택하였다.
대상 데이터
- GPU 기반 움직임 예측의 수행시간에는 CPU와 GPU 간의 통신시간을 포함시켰다. 실험을 위하여 Geforce GTX 470을 사용하였다. 표 4는 HM 의 전역탐색 및 고속탐색 대비 GPU 기반 정수화소 움직임 예측 모듈의 속도향상을 나타낸다.
- 전술한 병렬화 기법들을 종합하여 소프트웨어 기반 실시간 HEVC 인코더를 구현하여 측정한 부호화 속도는 표 5와 같다. 실험을 위한 부호화 구조는 LDP (low-delay P)를 사용하였으며, QP는 22, 27, 32, 37을 사용하였다. 또한, 참조 픽쳐의 수는 1개로 고정하였으며, 최대 CTU 크기는 32×32 를 사용하여 부호화를 수행하였다.
이론/모형
- HEVC 인코더에서는 최적의 율-왜곡 값을 계산하기 위하여 SAD (sum of absolute difference), SATD (sum of absolute transformed difference), SSE (sum of square error)의 세 가지 cost 함수를 사용한다. 이러한 cost 함수들은 HEVC 참조 소프트웨어인 HM을 기준으로 인코더 전체 복잡도의 30% 이상의 높은 비율을 차지한다[9].
- 따라서, 한 CTU내의 모든 PU들은 동일한 MVP를 사용하게 된다. 탐색 방법은 전역탐색 (full-search)를 사용하고, 작은 PU들의 SAD를 더하여 더 큰 PU의 SAD를 도출해 내는 계층적 SAD 계산 (hierarchical SAD computing)과 여러 율-왜곡값 중에서 최솟값을 찾기 위한 CPR (concurrent parallel reduction) 알고리듬을 적용하였다[15]. 또한, 보다 정밀한 움직임 예측을 위해 참조 프레임에 대한 보간 필터 수행과[16] 분수 화소 단위 움직임 예측도 GPU에서 수행하였다.
성능/효과
- 1절에서 전술한 cost 함수 외에도 비디오 코덱에서 SIMD 명령어를 적용하기 적합한 대표적인 연산으로 변환및 역-변환을 꼽을 수 있다. HEVC에서는 기존의 비디오 코덱에 비하여 큰 단위의 변환 커널을 사용하고 쿼드-트리 (quad-tree)구조의 TU를 사용함으로서 부호화 성능을 향상시킬 수 있었다. HEVC는 기존 비디오 코덱에서 사용되던 4×4 및 8×8 크기의 변환 커널 뿐만 아니라, 16×16 및 32×32 크기의 큰 변환 커널을 채택하고 있다.
- 또한, OpenMP를 이용한 CPU 멀티스레딩 기법을 통해 슬라이스및 타일 단위 병렬처리를 수행하였으며, CUDA를 이용한 GPU 멀티스레딩 기법을 통해 움직임 예측 및 모드 결정에 대한 병렬처리를 수행하였다. OpenMP를 이용한 CPU 멀티스레딩 기법을 적용하여 4개 슬라이스와 타일로 분할하는 경우 약 3.5배의 부호화 속도 향상을 얻을 수 있었으며, 16개로 분할하는 경우에는 약 6배의 부호화 속도 향상을 얻을 수 있었다. 전술한 다양한 병렬화 기법을 적용하여 HEVC 인코더의 부호화 속도를 832×480 영상의 경우 10~30fps, 1920×1080 영상의 경우 5~10fps로 향상시킬 수있었다.
- 서로 다른 데이터에 대한 동일한 연산을 반복적으로 수행하는 cost 함수, 변환 및 역-변환, 보간 필터에 SIMD 명령어를 적용하여 DLP를 수행하였다. SIMD 명령어를 이용한 DLP 를 적용하여 HEVC 인코더 소프트웨어의 부호화 속도를 부호화 효율의 저하 없이 약 2배 향상시킬 수 있었다. 또한, OpenMP를 이용한 CPU 멀티스레딩 기법을 통해 슬라이스및 타일 단위 병렬처리를 수행하였으며, CUDA를 이용한 GPU 멀티스레딩 기법을 통해 움직임 예측 및 모드 결정에 대한 병렬처리를 수행하였다.
- 표 3은 본 연구에서 SIMD 명령어를 적용하기 전과 후의 부호화 속도 향상을 나타낸다. SIMD 명령어를 적용하여 부호화 손실 없이 평균 45.92%의 ATS 효율을 얻을 수 있었다. SIMD 명령어를 적용한 연산별로 속도 향상을 살펴 보면, SAD, SATD, SSE의 cost 함수의 경우 평균 4배의 연산 속도 향상을 나타내었으며, 변환 및 역-변환의 경우 partial butterfly 방식 대비 평균 3~4배의 연산 속도 향상을 나타내었다.
- SIMD 명령어를 적용한 연산별로 속도 향상을 살펴 보면, SAD, SATD, SSE의 cost 함수의 경우 평균 4배의 연산 속도 향상을 나타내었으며, 변환 및 역-변환의 경우 partial butterfly 방식 대비 평균 3~4배의 연산 속도 향상을 나타내었다.
- 2배의 부호화 속도 향상을 얻을 수 있었다. 또한, 8개 슬라이스와 타일로 분할한 경우 평균 4.5배의 부호화 속도 향상이 있었으며, 16개슬라이스와 타일로 분할한 경우 평균 5.5배의 부호화 속도 향상을 얻을 수 있었다. CPU 멀티스레딩 기법을 이용한 병렬화 기법의 경우 타겟 플랫폼이 지원하는 최대 스레드 수에 영향을 받으며, 슬라이스와 타일 수를 증가시키더라도 부호화 속도가 선형적으로 증가하지 않는다.
- SIMD 명령어를 적용한 연산별로 속도 향상을 살펴 보면, SAD, SATD, SSE의 cost 함수의 경우 평균 4배의 연산 속도 향상을 나타내었으며, 변환 및 역-변환의 경우 partial butterfly 방식 대비 평균 3~4배의 연산 속도 향상을 나타내었다. 또한, 보간 필터의 경우 평균 4배의 연산 속도 향상을 나타내었다.
- 현재, HEVC는 64×64 블록 크기부터, 32×32, 16×16, 8×8에 이르는 블록 크기의 CU 단위 부호화를 수행한다. 또한, 화면 내 예측 방향성의 증가, 움직임 예측 결정 기법의 향상, 움직임 벡터 병합 및 다양한 인-루프 필터를 적용하여 압축 효율을 향상시켰다.
- HM 인코더의 전체 동작 사이클에서 각 cost 함수가 차지하는 비율을 살펴보면 다음과 같다. 먼저, SAD 와 SATD는 각각 정수화소와 분수화소의 움직임 예측에서 원본 영상 블록과 예측 영상 블록간의 차를 구하는데 사용되며, HM 인코더의 전체 동작 사이클에서 SAD는 10~12%, SATD는 15~16%의 비율을 차지한다. 또한, SSE는 최적의 율-왜곡 값을 계산하는데 사용되는 연산으로 HM 인코더의 전체 동작 사이클에서 2~3%의 비율을 차지한다.
- 그림 9는 본 연구에서 수행한 CPU 단위 멀티스레딩 기법을 사용하여 슬라이스 및 타일 단위 병렬처리 수와 그에 따른 부호화 속도 향상을 나타낸 그래프이다. 슬라이스와 타일은 최대 16개까지 분할하여 실험을 진행하였으며, 4개 슬라이스와 타일로 분할한 경우 평균 3.2배의 부호화 속도 향상을 얻을 수 있었다. 또한, 8개 슬라이스와 타일로 분할한 경우 평균 4.
- 그림 3에서는 변환 및 역-변환에 있어서 수직 방향의 메모리 로드가 필요하게 되므로 메모리 접근의 효율성이 떨어지게 된다. 이러한 문제점을 해결하기 위하여, 전치행렬 형태로 메모리에 저장하여 수직 방향의 메모리 로드로 발생하는 연산량을 줄일 수 있었다. 변환 및 역-변환에서 계수들은 16비트 데이터이므로중간 연산과정이 32비트인 점을 고려하면 4개의 데이터에 대해 동시 처리가능하다.
- 전술한 다양한 병렬화 기법을 적용하여 HEVC 인코더의 부호화 속도를 832×480 영상의 경우 10~30fps, 1920×1080 영상의 경우 5~10fps로 향상시킬 수있었다.
- 표 4는 HM 의 전역탐색 및 고속탐색 대비 GPU 기반 정수화소 움직임 예측 모듈의 속도향상을 나타낸다. 전역탐색의 경우 평균 364배의 속도향상을 보이며, GPU 기반 움직임 예측이 전역탐색 방법을 사용함에도 불구하고 HM의 고속탐색 방법 대비 평균 11배의 속도향상을 보인다.
후속연구
- CPU 멀티스레딩 기법을 이용한 병렬화 기법의 경우 타겟 플랫폼이 지원하는 최대 스레드 수에 영향을 받으며, 슬라이스와 타일 수를 증가시키더라도 부호화 속도가 선형적으로 증가하지 않는다. 따라서 적용 하고자하는 타겟 플랫폼에서 가장 효율적인 슬라이스와 타일 분할 수에 대한 결정이 필요할 것으로 예상된다.
- 본 논문에서는 SIMD 명령어를 이용한 DLP를 cost 함수, 변환 및 역-변환, 보간 필터에 적용하였으나, 이외에도 화면 내 예측 수행과정에서의 참조샘플 필터 연산, 복원 영상 생성 등 SIMD 명령어를 적용할 수 있는 연산 및 모듈이 존재한다. 또한, CPU 및 GPU 멀티스레딩 기법의 병렬 처리 속도 향상을 위하여 고속화 알고리즘 연구가 필요할 것으로 예상된다. 현재 832×480 영상의 경우 실시간 부호화가 가능하지만, 2K 및 4K 영상에 대한 실시간 부호화가 가능한 HEVC 인코더 개발을 위하여 추가적인 소프트웨어 최적화 및 병렬화 연구를 진행할 계획이다.
- 현재 832×480 영상의 경우 실시간 부호화가 가능하지만, 2K 및 4K 영상에 대한 실시간 부호화가 가능한 HEVC 인코더 개발을 위하여 추가적인 소프트웨어 최적화 및 병렬화 연구를 진행할 계획이다.
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