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[국내논문] 비대칭 이중게이트 MOSFET에 대한 DIBL의 채널도핑농도 의존성
Dependence of Channel Doping Concentration on Drain Induced Barrier Lowering for Asymmetric Double Gate MOSFET 원문보기

한국정보통신학회논문지 = Journal of the Korea Institute of Information and Communication Engineering, v.20 no.4, 2016년, pp.805 - 810  

정학기 (Department of Electronic Eng., Kunsan National University)

초록
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본 논문에서는 비대칭 이중게이트 MOSFET의 채널 내 도핑농도에 대한 드레인 유도 장벽 감소 현상에 대하여 분석하고자한다. 드레인 유도 장벽 감소 현상은 드레인 전압에 의하여 소스 측 전위장벽이 낮아지는 효과로서 중요한 단채널 효과이다. 이를 분석하기 위하여 포아송방정식을 이용하여 해석학적 전위분포를 구하였으며 전위분포에 영향을 미치는 채널도핑 농도뿐만이 아니라 상하단 산화막 두께, 하단 게이트 전압 등에 대하여 드레인 유도 장벽 감소 현상을 관찰하였다. 결과적으로 드레인 유도 장벽 감소 현상은 채널도핑 농도에 따라 큰 변화를 나타냈다. 채널길이가 25 nm 이하로 감소하면 드레인 유도 장벽 감소 현상은 급격히 상승하며 채널도핑농도에도 영향을 받는 것으로 나타났다. 산화막 두께가 증가할수록 도핑농도에 따른 드레인유도장벽감소 현상의 변화가 증가하는 것을 알 수 있었다. 채널도핑 농도에 관계없이 일정한 DIBL을 유지하기 위하여 상단과 하단의 게이트 산화막 두께가 반비례하는 것을 알 수 있었다. 또한 하단게이트 전압은 그 크기에 따라 도핑농도의 영향이 변화하고 있다는 것을 알 수 있었다.

Abstract AI-Helper 아이콘AI-Helper

The dependence of drain induced barrier lowering(DIBL) is analyzed for doping concentration in channel of asymmetric double gate(DG) MOSFET. The DIBL, the important short channel effect, is described as lowering of source barrier height by drain voltage. The analytical potential distribution is deri...

Keyword

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문제 정의

  • DIBL은 단채널이기 때문에 드레인 전압이 소스 측 에너지장벽에 영향을 미치는 현상으로써 문턱전압 이동의 척도가 되고 있다. 본 논문에서는 비대칭 DGMOSFET의 DIBL현상이 채널 내 도핑농도에 따라 어떻게 변화하는지를 고찰하고자 한다. 이를 위하여 Ding 등의 포아송방정식 해법을 이용할 것이다[4].
  • 그러나 비대칭 이중게이트 MOSFET에서는 아직 이에 대한 수식적 모델을 구하기 위한 기초 연구가 미흡한 상태이므로 본 논문에서는 채널 도핑 농도, 산화막 두께 그리고 하단게이트 전압 등에 따른 비대칭 이중게이트 MOSFET의 드레인 유도 장벽 감소 현상을 고찰할 것이다. 즉, 본 논문에서는 상기 서술한 바와 같이 식 (7)을 이용하여 채널도핑 농도를 파라미터로 채널길이, 상하단 산화막 두께 및 하단게이트 전압 등에 대한 비대칭 이중게이트 MOSFET의 드레인 유도 장벽 감소 현상에 대하여 고찰 할 것이다.
  • 본 논문에서는 비대칭 이중게이트 MOSFET의 채널도핑농도, 상하단 게이트 산화막 두께 및 하단 게이트 전압의 변화에 대한 DIBL 현상에 대하여 분석하였다. 특히 비대칭 이중게이트 MOSFET는 상단과 하단의 게이트 구조를 다르게 제작할 수 있으므로 상단과 하단 게이트 산화막 두께 변화 및 하단 게이트 전압에 대한 DIBL의 변화를 관찰하였다.

가설 설정

  • 식 (2)에서 알 수 있듯이 포아송 방정식을 이용하여 전위를 구할 때 채널 내 도핑농도는 전위분포 결정에 큰 변수가 된다. 또한 경계 조건에서 알 수 있듯이 산화막 커패시턴스는 산화막 두께에 따라 변화하므로 산화막 두께는 전위분포에 영향을 미칠 것이며 하단 게이트 전압도 전위 분포에 영향을 미칠 것이다. 이와 같이 채널 내 도핑농도 및 산화막 두께 그리고 하단 게이트 전압 등의 경계조건을 이용하여 식 (1)을 풀면 다음과 같은 급수형태의 전위분포를 구할 수 있다[4].
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참고문헌 (7)

  1. Z.Zhu, D.Yan, G.Xu and X.Gu,"Drain current model of double-gate MOSFETs considering both electrons and holes," IEEJ Trans. on Electrical and Electronic Engineering, vol.9, no.3, pp.262-266, May 2014. 

  2. V.Kumari, M.Saxena, R.S.Gupta and M.Gupta, "Analytical Modeling of Dielectric Pocket Double-Gate MOSFET Incorporating Hot-Carrier-Induced Interface Charges," IEEE Trans. on Device and Materials Reliability, vol.14, no.1, pp.390-399, March 2014. 

  3. S.Mohammadi, A.Afzali-Kusha and S.Mohammadi, "Compact modeling of short-channel effects in symmetric and asymmetric 3-T/4-T double gate MOSFETs," Microelectronics Reliability, vol.51, pp.543-549, March 2011. 

  4. Z.Ding, G.Hu, J.Gu, R.Liu, L.Wang and T.Tang,"An analytical model for channel potential and subthreshold swing of the symmetric and asymmetric double-gate MOSFETs," Microelectronics J., vol.42, pp.515-519, March 2011. 

  5. Hakkee Jung, "Analysis for Potential Distribution of Asymmetric Double Gate MOSFET Using Series Function," J. of KIICE, vol.17, no.11, pp.2621-2626. Nov. 2013. 

  6. G.Massobrio and P.Antognetti, Semiconductor Device Modeling with SPICE, 2nd, McGraw-Hill, New York, pp.205-206, 1993. 

  7. H.K.Jung and O.S.Kwon,"Analysis of Channel Dimension Dependent Threshold Voltage for Asymmetric DGMOSFET," 2014 International Conference on Future Information & Communication Engineering, vol.6, no.1, pp.299-302, 2014. 

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