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NTIS 바로가기한국정보전자통신기술학회논문지 = Journal of Korea institute of information, electronics, and communication technology, v.11 no.3, 2018년, pp.283 - 289
한대현 (Department of Electronic Dongeui University)
A PLL with an unipolar charge pump and a loop filter consisting of sample-hold capacitor and Fvco-sampled feedforward loop filter. The proposed PLL not only reduces the chip area by replacing the resistance to a switch and a small capacitor but also reduces the variation of
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핵심어 | 질문 | 논문에서 추출한 답변 |
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제안된 위상고정루프의 특징은? | 샘플-홀드 커패시터와 전압제어발진기 신호에 동작하는 피드포워드 루프필터를 가진 단방향 전하펌프를 가진 위상고정루프를 제안하였다. 제안된 위상고정루프는 기존의 2차 RC 필터에 비해서 저항 대신에 스위치와 작은 작은 크기의 커패시터를 사용하여 칩 크기를 줄일 수 있을 뿐만 아니라 전압제어발진기의 위상잡음에 영향을 미치는 ${\Delta}VLPF$의 변화량과, 기준신호 의사잡음에 영향을 미치는 ${\Delta}{\Delta}VLPF$의 변화량을 각각 1/5과 1/6로 줄였다. 제안된 위상고정루프는 1. | |
단방향 전하펌프의 역할은? | 그림 7의 단방향 전하펌프는 주파수검출기에서 나온 UP/DN 신호에 따라 전류의 흐름을 제어하는 역할을 한다. 본 논문에서 사용된 전하펌프는 그림 7에 나타난 바와 같이, 캐스코드(cascode) 구조를 사용하였다. | |
양방향 전하펌프와 2차 루프필터를 가진 기존 구조의 위상고정루프를 시뮬레이션한 결과는? | 제안된 구조와의 비교를 위해 양방향 전하펌프와 2차 루프필터를 가진 기존 구조의 위상고정루프를 시뮬레이션하였다. 15.625MHz의 기준주파수를 가지고 출력 주파수는 1GHz이며, 분주비는 64이다. 이 회로의 변수 값은 Icp=200μA, Cp=100pF, Rz=1.5KΩ, Cz=1nF, KVCO=330MHz/V이며, 0.18μm CMOS 공정으로 HSPICE로 시뮬레이션 하였다. 그림 8에 기존 2차 루프필터를 가진 위상고정루프의 시뮬레이션 결과를 보였다. 그림 8 (a)는 18 μs에서 위상이 고정되는 것을 보여주고 있으며, 그림 8 (b)는 위상고정 이후 발생하는 루프 필터 전압 크기 변화량 △VLPF는 1.2mV의 값을 가지며, 그림 8 (c)는 기준신호 주기마다 발생하는 △△VLPF의 크기가 190μV 임을 인 것을 보여주고 있다. |
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