[논문]쓰기 횟수 감소를 위한 하이브리드 캐시 구조에서의 캐시간 직접 전송 기법에 대한 연구

최주희

[국내논문] 쓰기 횟수 감소를 위한 하이브리드 캐시 구조에서의 캐시간 직접 전송 기법에 대한 연구
A Study on Direct Cache-to-Cache Transfer for Hybrid Cache Architecture to Reduce Write Operations

반도체디스플레이기술학회지 = Journal of the semiconductor & display technology, v.23 no.1, 2024년, pp.65 - 70

최주희 (상명대학교 스마트정보통신공학과)

Abstract ▼ AI-Helper

Direct cache-to-cache transfer has been studied to reduce the latency and bandwidth consumption related to the shared data in multiprocessor system. Even though these studies lead to meaningful results, they assume that caches consist of SRAM. For example, if the system employs the non-volatile memory, the one of the most important parts to consider is to decrease the number of write operations. This paper proposes a hybrid write avoidance cache coherence protocol that considers the hybrid cache architecture. A new state is added to finely control what is stored in the non-volatile memory area, and experimental results showed that the number of writes was reduced by about 36% compared to the existing schemes.

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참고문헌 (14)

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