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High speed multiplexer design using tree based decomposition algorithm

Microelectronics journal, v.51, 2016년, pp.99 - 111  

Basiri M, M.A. ,  Mahammad Sk, N.

Abstract AI-Helper 아이콘AI-Helper

This paper proposes an effective algorithm to design a larger multiplexer using a tree of smaller multiplexers for a particular user defined library. The proposed algorithm outputs the larger multiplexer into a tree based structure, which gives the scope to pipeline the larger multiplexer as per the...

주제어

참고문헌 (24)

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  18. IEEE J. Solid State Circuits Stefanos 32 11 1683 1997 10.1109/4.641688 A semidigital dual delay-locked loop 

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  24. Hubert 2008 Digital Integrated Circuit: From VLSI Architecture to CMOS Fabrication 

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