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[국내논문] 디지털 PLL을 위한 높은 해상도를 갖는 시간-디지털 변환기의 연구
A Study on High Resolution Time to Digital Converter for All Digital PLL 원문보기

대한전자공학회 2008년도 하계종합학술대회, 2008 June 18, 2008년, pp.587 - 588  

김용우 (숭실대학교 전자공학과) ,  안태원 (동양공업전문대학 전기전자통신공학부) ,  문용 (숭실대학교 전자공학과)

초록
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Digital PLL을 위한 높은 해상도를 갖는 TDC(Time to Digital Converter)를 $0.18{\mu}m$ CMOS 공정으로 설계하였다. 2단 구조를 갖는 TDC를 제안하였고 이를 Cadence Spectre를 이용하여 검증하였다. TDC는 Difference pulse generator, coarse 변환기와 fine 변환기로 구성된다. 그리고, 2단 변환기와 Thermometer decoder를 이용하여 delay cell의 수를 적게 유지하면서도 높은 해상도를 얻을 수 있었다.

AI 본문요약
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문제 정의

  • 이에 본 연구에서는 시간의 디지털 변환을 coarse 변환단과 fine 변환단으로 구분하여 해상도를 크게 개선할 수 있는 TDC를 제안하고 이를 모의실험을 통해서 검증하였다.
  • 그러나, 두 가지 방법 모두 많은 수의 지연셀이 필요하므로 그 복잡도가 크다고 하겠다. 이에 본 연구에서는 coarse 변환단에서 1차 시간을 알아내어 MSB를 결정하고, fine 변환단에서 신호의 차이만을 이용하여 세밀한 지연시간을 검출하여 LSB를 결정하는 구조를 제안하고자 한다.
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