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전압 상승률을 기반으로 하는 인버터의 출력 필터 설계
LC Filter Design Limiting Voltage Slew Rate 원문보기

전력전자학회 2016년도 전력전자학술대회 논문집, 2016 July 05, 2016년, pp.331 - 332  

최영현 (서울대학교) ,  최현규 (서울대학교) ,  하정익 (서울대학교)

초록
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본 논문에서는 PWM 슬루율을 제한하기 위한 LC 필터 설계를 제안한다. 기존의 연구에서는 PWM 입력전압과 필터링된 출력 전압에 대한 주파수 분석을 통해 출력단에 나타나는 슬루율을 제한하였다. 하지만 이러한 분석은 순시 출력 슬루율을 정량적으로 분석하기 어렵다. 본 논문에서는 LC필터의 출력 슬루율을 시간 영역에서 분석하고, 이를 제한하는 LC 필터의 정량적인 설계법을 제시한다.

AI 본문요약
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문제 정의

  • 논문에서 제시한 저역 필터는 상승 시간 내에 필터링된 출력의 슬루율을 감소시키는 것에 목적이 잇다. LF가 클수록 필터의 슬루율 제한 성능은 증가하지만, LF에 걸리는 기본파 주파수의 전압이 커지게 되어 전동기의 동특성을 해치게 된다.
  • 이를 해결하기 위해 기존 연구에서는 주파수 분석을 통한 필터 설계를 하였다. 본 논문에서는 시간영역 분석을 통해 수동소자를 사용한 저역필터 설계 방법을 정량적으로 제시하였다. 설계한 필터는 인버터 출력에 추가하여 출력의 슬루율을 제한하며, 시뮬레이션을 통해 출력의 슬루율이 4kV/us을 넘지 않는 다는 것을 검증 하였다.
  • 본 논문에서는 저역필터의 슬루 제한 성능을 시간 영역에서 분석하고 NEMA standard MG-1에서 제시한 4kV/μs으로 슬루율로 제한하기 위해 수동소자 저역 필터 디자인 방법을 정량적으로 제시한다.
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