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NTIS 바로가기국가/구분 | 한국(KR)/등록특허 | |
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국제특허분류(IPC8판) |
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출원번호 | 10-2021-7028205 (2021-09-02) | |
공개번호 | 10-2021-0111365 (2021-09-10) | |
등록번호 | 10-2551155-0000 (2023-06-29) | |
우선권정보 | 미국(US) 62/801,908 (2019-02-06);미국(US) 16/779,830 (2020-02-03) | |
국제출원번호 | PCT/US2020/016467 (2020-02-04) | |
국제공개번호 | WO 2020/163249 (2020-08-13) | |
번역문제출일자 | 2021-09-02 | |
DOI | http://doi.org/10.8080/1020217028205 | |
발명자 / 주소 |
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대리인 / 주소 |
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심사청구여부 | 있음 (2021-09-02) | |
심사진행상태 | 등록결정(일반) | |
법적상태 | 등록 |
메모리 디바이스들이 설명된다.메모리 디바이스들은, 교대하는 메모리 층들 및 유전체 층들의 스택을 통해 연장되는 복수의 비트 라인들을 포함한다.메모리 층들 각각은 단결정질-유사 실리콘 층을 포함하고, 제1 워드 라인, 제2 워드 라인, 제1 커패시터 및 제2 커패시터를 포함한다.적층형 메모리 디바이스들을 형성하는 방법들이 또한 설명된다.
메모리 디바이스로서,교대하는 메모리 층들 및 유전체 층들의 스택을 통해 연장되는 복수의 비트 라인들을 포함하고, 상기 메모리 층들 각각은, 단결정질-유사 실리콘(single crystalline-like silicon) 층을 포함하는 제1 워드 라인 ―상기 제1 워드 라인은 상기 복수의 비트 라인들의 제1 측(side)에 인접한 제1 측 및 상기 제1 워드 라인의 제1 측에 대향하는 제2 측을 가짐―,단결정질-유사 실리콘 층을 포함하는 제2 워드 라인 ―상기 제2 워드 라인은 상기 복수의 비트 라인들의 제2 측에 인접한 제1 측 및
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