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Method for manufacturing self-aligned titanium salicide using two two-step rapid thermal annealing steps 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/44
출원번호 US-0906554 (1997-08-05)
우선권정보 TW-86109783 (1997-07-11)
발명자 / 주소
  • Chen Chun-Cho,TWX
  • Hsu Jui-Lung,TWX
출원인 / 주소
  • Utek Semiconductor Corp., TWX
인용정보 피인용 횟수 : 14  인용 특허 : 6

초록

A method of manufacturing self-aligned titanium salicide is provided which includes the steps of forming a LOCOS isolation region on a silicon substrate, forming a titanium layer on the surface of the silicon substrate, performing a first two-step rapid thermal anneal on the silicon substrate in an

대표청구항

[ We claim:] [1.] A method of manufacturing self-aligned titanium salicide, comprising the steps of:(a) forming a LOCOS isolation region on a silicon substrate having a surface;(b) forming a titanium layer on the surface of the silicon substrate;(c) performing a first two-step rapid thermal anneal o

이 특허에 인용된 특허 (6)

  1. Salimian Siamak ; Heller Carol M. ; Li Lumin, Electrode designs for controlling uniformity profiles in plasma processing reactors.
  2. Saito Shuichi,JPX, Method of fabricating semiconductor device having a salicide structure.
  3. Lau, Chi K., Method of forming a titanium disilicide.
  4. Kao Dah-Bin (Palo Alto CA) Pierce John (Palo Alto CA), Self-aligned polycide process that utilizes a planarized layer of material to expose polysilicon structures to a subsequ.
  5. Jenq Jason,TWX ; Chen Tung-Po,TWX, Self-aligned silicide manufacturing method.
  6. Nulman Jaim (Palo Alto CA), Single anneal step process for forming titanium silicide on semiconductor wafer.

이 특허를 인용한 특허 (14)

  1. Austin Frenkel DE; Akif Sultan ; Paul Besser, Advanced cobalt silicidation with in-situ hydrogen plasma clean.
  2. Gelb, Allan S.; Platt, Bruce D., Coated electrode and method of making a coated electrode.
  3. Platt,Bruce; Gelb,Allan S., Coated electrode and method of making a coated electrode.
  4. Maa Jer-Shen ; Hsu Sheng Teng ; Peng Chien-Hsiung, MOS transistor having shallow source/drain junctions and low leakage current.
  5. Kawahara, Naoyoshi, Manufacturing method of semiconductor device.
  6. Maekawa, Kazuyoshi, Method for manufacturing a semiconductor device.
  7. Apalkov, Dmytro; Erickson, Dustin William; Nikitin, Vladimir, Method for providing a high perpendicular magnetic anisotropy layer in a magnetic junction usable in spin transfer torque magnetic devices using multiple anneals.
  8. Goldbach, Matthias; Holz, Jürgen, Method of fabricating an integrated circuit.
  9. O'Brien Sean C., Method of fabricating self-aligned silicide.
  10. Gardner Mark I. ; Fulford ; Jr. H. Jim ; Spikes ; Jr. Thomas E., Method of making salicidation of source and drain regions with metal gate MOSFET.
  11. Chen Shu-Jen,TWX ; Chang Ruoh-Haw,TWX ; Hsu Chih-Ching,TWX, Method of manufacturing self-aligned silicide.
  12. Hamanaka, Nobuaki, Process for fabricating semiconductor device having silicide layer with low resistance and uniform profile and sputtering system used therein.
  13. Ganguli, Seshadri; Yu, Sang-Ho; Phan, See-Eng; Chang, Mei; Khandelwal, Amit; Ha, Hyoung-Chan, Process for forming cobalt and cobalt silicide materials in tungsten contact applications.
  14. Huang Jenn Ming,TWX, Silicide and salicide on the same chip.
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