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[국가R&D연구보고서] 컴퓨터를 이용한 순차논리회로의 설계
Computer-Aided Design of Sequential Logic Circuit 원문보기

보고서 정보
주관연구기관 서울대학교
Seoul National University
연구책임자 황희융
참여연구자 조동섭 , 김경식 , 김병철
발행국가대한민국
언어 한국어
발행년월1984-03
주관부처 과학기술부
연구관리전문기관 서울대학교
Seoul National University
등록번호 TRKO200200010240
DB 구축일자 2013-04-18

초록

스윗칭 함수설계는 조합논리(Combinational Logic) 와 순차논리 (Sequential Logic) 설계로 나누어 진다. 본 연구에서는 순차 논리회로의 설계를 컴퓨터로 처리하여 비용의 최소화와 설계의 신뢰도 및 신속성을 기하는데 목적을 두고 있다.
순차논리회로 설계 전산화에 있어서, 설계 최적화를 위해 필요한 컴퓨터 알고리즘을 개발하여 여러 예제에 적용하여 보았고 그 결과를 분석비교하였다.
동기식과 비동기식의 설계 알고리즘을 각각 제시하고 다출력 논리회로 설계 알고리즘을 순차논리회로에

Abstract

Logic Design of switching function is generally devided in two groups: combinational logic design, and sequential logic design. The object of this study is to design the sequential logic circuit of the minimal cost with the aid of computer.
In design automation of sequential logic. Comp

목차 Contents

  • 도표목차...5
  • 그림1.동기식 순차 논리 회로의 설계과정...6
  • 그림2.비동기식 순차 회로의 기본 모델...11
  • 그림3.순차 회로에서 분리된 조합 회로망...12
  • 그림4.MASK-SEQ의 흐름도...14
  • 표I.JK,T,D,RS 플립플럽의 여기맵...16
  • 표II.각 플립플럽 입력에 따른 다음 상태...17
  • 표III.축소형 흐름표...19
  • 그림5.원-핫 상태 지정의 예...20
  • 표IV.이진화 축소형 흐름표...25
  • 표V.5카운터의 상태 천이표...27
  • 표VI.축소형 흐름표...30
  • 그림6.제안된 설계법 MASK-ASEQ에 의한 결과...31
  • 그림7.원-핫 상태 지정에 의한 이진화 축소형 흐름표와 종래의 간소화법에 의한 결과...32

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참고문헌 (25)

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