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반도체공정의 웨이퍼검사 및 공정감시를 위한 지능적 의사결정지원시스템 개발
An Intelligent Decision Support System for Wafer Inspection and Process Monitoring in Semiconductor Processes 원문보기

보고서 정보
주관연구기관 강릉대학교
Kangnung National University
연구책임자 김성준
보고서유형최종보고서
발행국가대한민국
언어 한국어
발행년월2003-05
과제시작연도 2002
주관부처 과학기술부
사업 관리 기관 한국과학재단
Korea Science and Engineering Foundtion
등록번호 TRKO200900070592
과제고유번호 1350015009
사업명 목적기초연구사업
DB 구축일자 2013-04-18
키워드 반도체공정.불량패턴.의사결정나무.웨이퍼맵.공간지연.웨이퍼빈맵.공간적 자기상관.의사결정지원시스템.공정감시.Semiconductor Process.Defect Pattern.Decision Tree.Wafer Map.Spatial Lag.Wafer Bin Map.Spatial Autocorrelation.Decision Support System.Process Monitoring.

초록

웨이퍼맵은 웨이퍼 상에 불량칩이 발생한 위치를 표시해 둔 도표로서, 반도체공정의 분석에 사용되는 기초 데이터 중 하나이다. 보통 불량칩들이 보여주는 공간적 패턴에는 실제 공정상태와 관련된 유용한 정보가 담겨 있으므로, 웨이퍼맵 분석은 공정을 더 잘 이해하고 불량칩 발생을 억제하는 데 도움이 될 수 있다. 본 연구는 웨이퍼맵에 나타난 불량칩의 공간적 특성을 모델링하고 분석하기 위한 절차를 개발하고, 이를 기반으로 공정감시를 위한 의사결정지원시스템 활용방안을 제시한다.
웨이퍼맵에 등장하는 불량칩의 공간적 특성을 측정하기 위해 공간

Abstract

Wafer map, a graphical illustration of the locations of defective chips on the wafer, is one of the fundamental data used in semiconductor process analysis. Since the spatial pattern exhibited by defective chips contains a useful information about actual process states, the wafer map analysis helps

목차 Contents

  • Ⅰ. 연구계획 요약문 ...3
  • 1. 국문요약문 ...3
  • Ⅱ. 연구결과 요약문 ...4
  • 1. 국문요약문 ...4
  • 2. 영문요약문 ...5
  • Ⅲ. 연구내용 ...6
  • 1. 서론 ...6
  • 2. 연구방법 및 이론 ...7
  • 2.1 Join Count를 근거한 공간통계량의 개발 ...7
  • 2.2 공간지연을 고려한 SACF의 개발 ...10
  • 2.3 다변량 목표변수에 의한 의사결정나무 ...12
  • 3. 결과 및 고찰 ...16
  • 4. 결론 ...18
  • 5. 인용문헌 ...19
  • 6. 부록 ...20

참고문헌 (25)

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