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3Gbps급 4G 무선LAN 시스템 개발
IMT-Advanced Radio Transmission Technology with Low Mobility 원문보기

보고서 정보
주관연구기관 한국전자통신연구원
Electronics and Telecommunications Research Institute
연구책임자 정현규
참여연구자 이석규 , 방승찬 , 김성락 , 경문건 , 원석호 , 김영훈 , 최지연 , 전선심 , 이제헌 , 이수희 , 박재우 , 강헌식 , 이유로 , 오종의 , 정민호 , 장갑석 , 송유승 , 김근영 , 유철희 , 나해영 , 김윤주 , 최은영 , 이일구 , 손정보 , 윤찬호 , 김철중 , 박현구 , 신선경 , 김병찬 , 이용호
보고서유형최종보고서
발행국가대한민국
언어 한국어
발행년월2008-12
과제시작연도 2008
주관부처 지식경제부
사업 관리 기관 정보통신연구진흥원
Institute for Information Technology Advancement
등록번호 TRKO200900074433
과제고유번호 1415086628
사업명 정부통신연구개발
DB 구축일자 2013-04-18

초록

가. 최종 목표
$\cdot$ 3Gbps급 저속이동용 무선전송 기지국 및 단말 시험 시제품 개발
나. 연차별 연구 개발 내용
연구 개발은 크게 무선전송 기술 연구와 시제품 시제품 개발로 대별된다.
연도별 연구 내용은 다음과 같다.
1) 1차년도(2006년) 목표
- 저속이동 무선전송 PHY 규격 개발
- PHY 상위 설계
- MIMO-OFDM 수신 알고리듬 및 H/W 구조 설계
- 저속이동 무선전송 MAC 규격 개발
- MAC 상위설계
2) 2차년도(20

Abstract

A. Final Goal
$\cdot$ Development of IMT-Advanced radio transmission technology for low
mobility
B. Annual Contents of the Research and Development
Our research and development activities are macroscopically divided into two parts, research on transmission technology and devel

목차 Contents

  • 제 1 장 서론 ...29
  • 제 1 절 연구 개요 ...29
  • 제 2 절 연구개발의 내용 및 범위 ...32
  • 제 2 장 3Gbps급 무선전송을 위한 PHY 알고리듬의 설계 ...39
  • 제 1 절 요약 ...39
  • 제 2 절 3Gbps급 무선전송을 위한 PHY 알고리듬 세부블록 ...42
  • 제 3 장 3Gbps급 무선전송을 위한 MAC 알고리듬의 설계 ...129
  • 제 1 절 요약 ...131
  • 제 2 절 3Gbps급 무선전송을 위한 MAC 알고리듬 세부블록 ...136
  • 제 4 장 결론 ...181
  • [표 2-1] 3Gbps급 무선 LAN 시스템에서의 MCS (구현 MCS 대표값) ...51
  • [표 2-2] 구현 MCS별 스크램블러의 처리시간 및 데이터 bit수 ...55
  • [표 2-3] LDPC 부호의 파라미터 ...57
  • [표 2-4] Mapping table for 1 bit group (BPSK) ...60
  • [표 2-5] Mapping table for 2 bit group (QPSK) ...60
  • [표 2-6] Mapping table for 4 bit group (16QAM) ...61
  • [표 2-7] Mapping table for 6 bit group (64QAM) ...61
  • [표 2-8] 지원 가능한 다양한 정보의 길이와 다양한 코드 비율 ...126
  • [표 3-1] 블록별 기능 ...132
  • [표 3-2] MCS에 따른 Lmax 값 ...138
  • [표 3-3] Multiple data rate-frame repetition number ...140
  • [표 3-4] Multiple data rate ...150
  • [표 3-5] MUX_CONTROL 기능 동작표 ...172
  • [표 3-6] 제어 레지스터의 종류와 설명 ...179
  • (그림 2-2) TX Vector ...163
  • (그림 2-10) DC 옵셋 제거 구조도 ...77
  • (그림 2-11) I/Q mismatch compensation 구조도 ...78
  • (그림 2-13) Carrier Sensing 블록 다이어그램 ...82
  • (그림 2-14) Carrie frequency offset estimation 블록 구조도 ...87
  • (그림 2-15) Carrier frequency offset compensation 구조도 ...88
  • (그림 2-18) Carrier frequency error estimation 블록 다이어그램 ...96
  • (그림 2-19) Carrier phase error estimation 블록 다이어그램 ...97

연구자의 다른 보고서 :

참고문헌 (25)

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