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NTIS 바로가기주관연구기관 | 성균관대학교 SungKyunKwan University |
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연구책임자 | 이강윤 |
보고서유형 | 최종보고서 |
발행국가 | 대한민국 |
언어 | 한국어 |
발행년월 | 2016-06 |
과제시작연도 | 2015 |
주관부처 | 미래창조과학부 Ministry of Science, ICT and Future Planning |
등록번호 | TRKO201700013797 |
과제고유번호 | 1345236939 |
사업명 | 이공학개인기초연구지원 |
DB 구축일자 | 2017-11-18 |
DOI | https://doi.org/10.23000/TRKO201700013797 |
○ 저 전력 ADPLL을 이용한 주파수 합성기 구조연구 및 개발
- 저전력 ADPLL은 Reference Clock과 회로 내의 Clock간의 Phase 및 Frequency를 Time to Digital Converter(TDC)를 통해 Measure한 후, Digital Controlled Oscillator(DCO)에서 주파수 정보로 이를 변환하여 Reference Clock과의 Feedback에 의해 Frequency가 Locking이 되도록 구성됨. ADPLL의 전류소모는 2.4mA 이며 DCO의 phase noise
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