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Growld Plane SOI MOSFET의 단채널 현상 개선
Reduction of short channel Effects in Ground Plane SOI MOSFET′s 원문보기

電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체, v.41 no.4 = no.322, 2004년, pp.9 - 14  

장성준 (시립 인천대학교 전자공학과) ,  윤세레나 (립 인천대학교 전자공학) ,  유종근 (립 인천대학교 전자공학) ,  박종태 (립 인천대학교 전자공학)

초록
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매몰 산화층 밑의 실리콘 기판에 자기정렬 방법으로 ground plane 전극을 만든 SOI MOSFET의 단채널 현상과 Punchthrough 특성을 측정·분석하였다. 채널 길이가 $0.2{\mu}m$ 이하의 소자에서는 GP-SOI 소자가 FD-SOI 소자보다 채널 길이에 따른 문턱전압 저하 및 subthreshold swing이 작고 DIBL 현상이 크게 개선됨을 알 수 있었다. 기판전압에 따른 문턱전압 특성으로부터 GP-SOI 소자의 body factor가 FD-SOI 소자보다 큰 것을 알 수 있었다. 그리고 punchthrough 전압 특성으로부터 GP-SOI 소자의 punchthrough 전압이 FD-SOI 소자보다 큰 것을 알 수 있었다.

Abstract AI-Helper 아이콘AI-Helper

This paper reports the measurement and analysis of the short channel effects and the punchthrough voltage of SOI-MOSFET with a self-aligned ground plane electrode in the silicon mechanical substrate underneath the buried oxide. When the channel length is reduced below 0.2${\mu}{\textrm}{m}$

주제어

참고문헌 (11)

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  9. M.Horinchi, T.Teshima, K.Tokurnasu, and K.Yamaguchi, 'High Current Small-Parasitic-Capacita nee MOSFET on a Poly-Si Interlayered(PSI:4) SOI wafer.' IEEE Trans. Electron Devices, vol.45 no.5, pp. 1111-1115, 1998 

  10. W.xiong, K.Ramkumar, S.J. Jang, J.T. Park, and J.P. Colinge,' Self-Aligned Ground-Plane FDSOI MOSFET.' Proc. of SOI/IEEE, pp. 23-24, 2002 

  11. T. Ernst, and S. Cristoloveanu, 'Buried Oxide Fringing Capacitance : A new Physical Model and its Implication on SOI Device Scaling and Arch itecture. 'Proc. of SOI/IEEE, pp. 38-39, 1993, pp. 345-357, June 1998 

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