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마이크로 패턴 구조를 이용한 플립칩 패키지 BGA의 최적 열설계
The Optimization of FCBGA thermal Design by Micro Pattern Structure 원문보기

마이크로전자 및 패키징 학회지 = Journal of the Microelectronics and Packaging Society, v.18 no.3, 2011년, pp.59 - 65  

이태경 (부산대학교 나노과학기술대학 차세대전자기판회로학과) ,  김동민 (부산대학교 나노과학기술대학 차세대전자기판회로학과) ,  전호인 (부산대학교 나노과학기술대학 차세대전자기판회로학과) ,  하상원 (삼성전기) ,  정명영 (부산대학교 나노과학기술대학 인지메카트로닉스공학과)

초록
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소형화, 박형화 및 집적화의 경향에 따라 FCBGA가 휴대폰과 같은 전자제품에 활발히 사용되고 있다. 그러나, 플립칩은 전기적 저항에 의한 열이 필연적으로 발생하며, 발생된 열은 패키지의 소형화에 따라 열의 분산 면적 감소로 인하여 발열의 증가가 나타나게 된다. 발열은 온도와 응력에 민감하게 반응하는 소자의 수명을 저해하고, 시스템에 있어 고장의 발생을 가져올 수 있다. 따라서 본 논문에서는 플립칩의 발열문제를 해결하기 위하여 Comsol 3.5a의 heat transfer module을 이용하여 FCBGA의 발열 특성을 정량적으로 분석하였다. 그리고 열 문제를 해결하기 위하여 시뮬레이션을 통한 새로운 마이크로 구조가 부착된 플립칩을 제안하였다. 또한 마이크로 패턴 구조의 형상, 높이, 간격에 대한 열 소산을 분석함으로써, 기존 플립칩에 비하여 열소산 특성이 18% 향상됨을 확인하였다.

Abstract AI-Helper 아이콘AI-Helper

According to the trends of electronic package to be smaller, thinner and more integrative, Flip Chip Ball Grid Array (FCBGA) become more used for mobile phone. However, the flip chip necessarily generate the heat by the electrical resistance and generated heat is increased due to reduced distributio...

주제어

AI 본문요약
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문제 정의

  • 따라서 본 논문의 다음절에서는 기존 열분산기 구조를 가지는 플립칩의 발열 및 방열특성을 더욱 향상시키기 위하여 마이크로 패턴구조를 열 분산기에 형상화하였고, 최적 조건을 찾고자 열해석 모델링을 시행하였다.
  • 본 논문에서는 Fig. 5에 제시한 것처럼, FCBGA의 발열 문제를 해결할 수 있는 모델을 제시하고자 한다. (a)의 경우, 기존의 열 분산기(heat spreader)를 사용한 모델이고, (b)의 경우, 기존의 열 분산자와 재료는 동일하지만, 표면에 마이크로 패턴구조를 형성시킨 모델이다.
  • 본 논문에서는 모듈의 고집적화 및 소형화 에 따라 발생하는 발열에 따른 성능 저하를 방지하기 위하여 기존의 플립칩에서의 발열 특성을 분석하였고, 발열 문제를 해결하기 위하여 플립칩의 상부에 마이크로 패턴을 부착하는 새로운 방열 구조의 모델을 제시하였으며, 패턴의 간격과 종횡비에 따른 발열특성의 분석을 통하여 고효율의 열소산 구조를 설계하였다.
  • 본 논문에서는 앞의 절에서 제시했듯이, 마이크로 패턴을 가진 플립칩의 최적의 열소산 구조를 찾기 위하여 열분산기의 다이 사이즈(die size), 패턴의 높이 및 패턴의 간격을 열 소산에 있어서의 해석변수로 두고 열해석을 진행하였다.
  • 본 논문에서는 칩, 언더필, 패키지 기판(package substrate), 솔더볼 및 메인보드로 구성된 플립칩 패키지의 최적 열설계를 위하여 플립칩 내의 열전달 경로를 파악하였다. 또한 플립칩의 열소산을 위해 플립칩의 구조 및 재질, 형상에 따른 열전달 특성을 Comsol 3.
  • 본 논문에서는 칩에서 발생하는 열량을 계산하여, 이에 따른 플립칩 내에서의 온도 변화를 살펴보고, 열원을 제거했을 때의 온도변화를 통하여 최적의 열 소산 모델을 제시하고자 한다.
  • 따라서, 플립칩 내에 발생된 열의 원활한 소산을 위해서는 플립칩에 있어서 전도에 의한 열전달 경로특성의 평가를 통해 열원(heat source)로부터 메인보드까지의 전체 열저항을 감소시켜야 한다. 이를 위해서 본 연구에서는 열소산을 위한 새로운 모델을 제시하고, 새로운 모델에 있어서의 전열면적, 전도율 및 두께 등의 열저항을 결정하는 변수들에 대한 열해석을 수행하여 이들에 따른 영향을 조사하였으며 이들의 조합을 통해 플립칩의 열저항을 감소시키기 위하여 마이크로 패턴 구조를 가지는 플립칩 모델을 제시하고자 한다. 최적 설계를 위한 시뮬레이션은 유한 요소 해석 s/w인 Comsol 3.
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질의응답

핵심어 질문 논문에서 추출한 답변
플립칩(Flip-Chip) 기술이란? 플립칩(Flip-Chip) 기술이란 전기적 장치나 반도체 소자들을 다양한 재료(솔더 범프, 전도성 고분자 필름, paste 등) 및 방법(증착법, 도금법, screen printing 등)을 이용한 접속을 통하여 칩의 표면이 기판을 향하도록 하여 칩을 기판에 실장하는 기술이다.1) 이러한 플립칩 기술은 기존의 주변정렬 방식을 가지는 와이어 본딩 기술에 비해 패키지 점유면적을 크게 줄일 수 있고 외부 잡음, 전기용량 및 인덕턴스 값이 기존의 패키지에 비하여 월등히 작고, 전기적 지연(Delay)을 줄일 수 있는 장점이 있어 최근 많이 사용되는 패키지 기술이다.
플립칩 기술의 장점은? 플립칩(Flip-Chip) 기술이란 전기적 장치나 반도체 소자들을 다양한 재료(솔더 범프, 전도성 고분자 필름, paste 등) 및 방법(증착법, 도금법, screen printing 등)을 이용한 접속을 통하여 칩의 표면이 기판을 향하도록 하여 칩을 기판에 실장하는 기술이다.1) 이러한 플립칩 기술은 기존의 주변정렬 방식을 가지는 와이어 본딩 기술에 비해 패키지 점유면적을 크게 줄일 수 있고 외부 잡음, 전기용량 및 인덕턴스 값이 기존의 패키지에 비하여 월등히 작고, 전기적 지연(Delay)을 줄일 수 있는 장점이 있어 최근 많이 사용되는 패키지 기술이다.
플립칩의 구조는 어떻게 구분할 수 있는가? 1에 나타내었다. 플립칩은 칩, 솔더범프, 패키지 기판, 솔더볼 및 메인보드로 크게 구분할 수 있다.
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참고문헌 (10)

  1. C. F. Coombs, "Printed Circuits Handbook," McGraw Hill Book Co., Chap.3, (2007). 

  2. Y. Song, S. B. Lee, S. H. Jeon, B. S. Yim, H. S. Chung and J. M. Kim "Underfill Flow Characteristics for Flip-Chip Packaging" J. Microelectron. Packag. Soc., 16(3), 39 (2009). 

  3. J. H. Ann, K. S. Kim, Y. C. Lee, Y. Kim and S. B. Jung "Regulation in Shear Test Method for BGA of Flip-chip Package", J. Microelectron. Packag. Soc., 17(3), 1 (2010). 

  4. Bai, C, and Veatch, M, "Chip scale package design for thermal performance in mobile handsets" Paper presented at the 2007 Electronic Components and Technology Conference. Proceedings. 57th, 1415 (2007) 

  5. S. H. Oh, C. S. Kim, B. S. Rho, S. B. Jung and M. Y. Jeong, "Thermal resistance control of an optical module packaging by a heat sink of high thermal conductivity", Mat. Sci. Forum 580-582, 163 (2008). 

  6. J. S. Corbin, "Finite Element Analysis for Solder Ball Connect (SBC) Structural design Optimization", IBM J. Research Development, 37(5), 585 (1993). 

  7. T. Lee and L. Jung, "Finite Element Analysis for Solder Ball Failures in Chip Scale Packages", Microelectronics and Reliability, 38(2), 1941 (1998). 

  8. J. W. Joo and D. H. Kim, "Thermo-mechanical Deformation Analysis of Flip Chip PBGA Packages subjected to Temperature Change", J. Microelectron. Packag. Soc., 13(4), 17 (2006). 

  9. Retuta, D., Ma, Y.Y., Kanth, R., Tan, H.B., Sun, A.,and Tanary, S., "Thermal Performance Enhancement for CSP Packages," Proc 57th Electronic Components and Technology Conf, Reno, NV, USA, 1690 (2007). 

  10. Mingzong Wang, Eason Chen, Jeng Yuan Lai, Yu-Po Wang, "High Power CSP Thermal Solutions", Electronic Packaging Technology, 2007.ICEPT 2007. 8th International Conference on, 1 (2007). 

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