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NTIS 바로가기한국정보통신학회논문지 = Journal of the Korea Institute of Information and Communication Engineering, v.16 no.8, 2012년, pp.1759 - 1764
This paper describes FPGA design and realization using the shading correction algorithm for a CCD scan image enhancement. The shading algorithm is used by LUT (Look-up Table). The image enhancement results from that the histogram minimum value and maximum with respect to all pixels of the CCD image ...
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핵심어 | 질문 | 논문에서 추출한 답변 |
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센서의 해상도가 높아지면 처리해야 하는 데이터양도 증가하는데 이에 따른 한계점은 무엇인가? | 센서의 해상도가 높아지면 처리해야 하는 데이터양도 함께 증가한다. 많은 데이터를 처리하기 위해서는 고가의 고속 프로세서를 사용하거나 신호처리 전용의 프로세서를 사용해야 하는 한계가 있다. 이러한 문제를 해결하기 위해 고속 이미지 데이터 처리를 위한 FPGA 사용한다. | |
CCD블록은 어떻게 구성되는가? | CCD블록은 센서 데이터를 A/D 변환하는 처리를 하며, 라인 CCD와 AMP, ADC로 구성된다. 각 센서 채널은 32um의 일정한 간격을 유지하고 있으며 병렬로 나란히 배열되어 있다. | |
쉐이딩 보정이란 무엇인가? | 쉐이딩 보정은 CCD 센서를 입력 장치로 사용하는 스캐너 시스템에서 균일한 이미지를 획득하기 위해 사용 하는 기법이다. 센서의 감도와 조도의 상태에 따라 스캔 이미지의 히스토그램 편차가 다르게 나타나기 때문에 대부분의 스캐너 시스템은 균일한 히스토그램을 갖는 이미지 획득을 위하여 센서 픽셀의 감도와 조도를 고려한 보정을 필요로 한다. |
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오픈액세스 학술지에 출판된 논문
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