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NTIS 바로가기한국산학기술학회논문지 = Journal of the Korea Academia-Industrial cooperation Society, v.15 no.4, 2014년, pp.2330 - 2334
김재욱 (남서울대학교 전자공학과)
In this study, we confirmed the frequency characteristics of planar spiral inductor based on non-contact method AC coupling for wireless signal transmission. The dielectric constant variation of the substrate does not directly effect the inductance of device but effect the electrostatic capacity of ...
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핵심어 | 질문 | 논문에서 추출한 답변 |
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AC커플링(Coupling)기반 평면 나선형 인덕터의 기판의 유전상수의 변화는 무엇을 야기하는가? | 본 논문에서는 무선 신호전송을 위한 비접촉 방식의 AC커플링(Coupling)기반 평면 나선형 인덕터의 주파수 특성을 분석하였다. 기판의 유전상수의 변화는 소자의 인덕턴스에 직접적인 영향을 주지 않고 소자의 전기용량에 영향을 주어 공진주파수를 변화시키는 것을 알 수 있다. 기판의 두께가 증가할수록 인덕턴스는 증가하지만 공진주파수는 감소하였으며, 이것은 기판 두께의 감소로 인해 내부 전기용량이 증가하였기 때문이다. | |
박막형 칩인덕터가 소형화에 유리한 이유는 무엇인가? | 이러한 표면 실장형 칩인덕터는 이동통신기기,디스크드라이브 등 각종 전자기기의 핵심소자로 사용되고 있으며 칩 간 무선신호 전송,무선 전력전송 등 다양한 분야에 활용될 수 있다[4].표면 실장형 칩인덕터는 박막형,권선형,적층형이 있는데 이 중 박막형 칩인덕터는 적층형 인덕터의 기본 구조로서 품질계수 Q값과 사용주파수 대역이 다른 구조에 비해 높으며 박막공정기술을 이용하기 때문에 소형화에 유리한 장점이 있다.이러한 특성으로 인해 고주파 영역에서 고정밀 용도로 주로 이용되고 있으며 고주파무선 신호 전송을 위한 AC커플링(Coupling)에도 활용할 수 있다[5,6]. | |
AC커플링(Coupling)기반 평면 나선형 인덕터의 기판의 두께가 증가할수록 인덕턴스는 증가하지만 공진주파수는 감소하는 이유는 무엇인가? | 기판의 유전상수의 변화는 소자의 인덕턴스에 직접적인 영향을 주지 않고 소자의 전기용량에 영향을 주어 공진주파수를 변화시키는 것을 알 수 있다. 기판의 두께가 증가할수록 인덕턴스는 증가하지만 공진주파수는 감소하였으며, 이것은 기판 두께의 감소로 인해 내부 전기용량이 증가하였기 때문이다. 인덕터의 도체 선 폭이 증가하여도 전체 인덕터 크기와 턴 수 및 선 간격이 일정함으로 내부 사각 코일의 도선 면적이 작아지게 되어 각각의 자기 인덕턴스가 감소하게 되고 공진주파수는 증가되게 된다. |
Shin Jae-Young, Song Byung-Moo, "Fabrication and Characteristic of Multi-Layer Chip Inductor", The Korean Ceramic Society, Ceramist, vol.2, no.4, pp.11-17, 1999.
Lei Luo, John M. Wilson, Stephen E. Mick, JianXu, Liang Zhang, and Paul D. Franzon, "3 Gb/s AC Coupled Chip-to-Chip Communication Using a Low Swing Pulse Receiver", IEEE Journal of Solid-State Circuits, vol.41, no.1, pp.287-296, Jan. 2006. DOI: http://dx.doi.org/10.1109/JSSC.2005.859881
Noriyuki Miura, Daisuke Mizoguchi, Mari Inoue, Kiichi Niitsu, Yoshihiro Nakagawa, Masamoto Tago, Muneo Fukaishi, "A 1 Tb/s 3 W Inductive-Coupling Transceiver for 3D-Stacked Inter-Chip Clock and Data Link", IEEE Journal of Solid-State Circuits, vol.42, no.1, pp.111-121, Jan. 2007. DOI: http://dx.doi.org/10.1109/JSSC.2006.886554
Sanjay K. Thakur, Rubin A. Parekhji, A. N. Chandorkar, "On-chip Test and Repair of Memories for Static and Dynamic Faults", IEEE International test conference, 2006.
John Wilson, Member, Stephen Mick, Jian Xu, Member, Lei Luo, Salvatore Bonafede, Alan Huffman, "Fully Integrated AC Coupled Interconnect, Using Buried Bumps", IEEE Trans. Actionson Advanced Packing, vol.30, no.2, pp.191-199, May 2007. DOI: http://dx.doi.org/10.1109/TADVP.2007.896920
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