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광대역 공간 결합 고출력 전력증폭기 개발
Development of Wideband Spatial Combined High Power Amplifier 원문보기

韓國電磁波學會論文誌 = The journal of Korean Institute of Electromagnetic Engineering and Science, v.28 no.4, 2017년, pp.286 - 297  

이호선 (알에프코어 주식회사) ,  박관영 (알에프코어 주식회사) ,  공동욱 (알에프코어 주식회사) ,  전종훈 (알에프코어 주식회사)

초록
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본 논문에서는 10개 단일 증폭기를 공간 결합하여 6~18 GHz의 광대역에서 동작하는 50 W급 공간 결합 고출력 전력 증폭기를 연구하였다. 동축형 공간 결합기는 안티-포달 안테나와 같은 원리로 동작하는 핀라인-마이크로스트립 라인 변환기로 이루어져 있으며, 이 변환기는 6~18 GHz의 광대역 특성을 갖도록 설계되었다. 그러므로 공간 결합기 설계에서 가장 중요한 부분은 PCB로 구현되는 핀라인-마이크로스트립 라인 변환기의 형상이며, 이는 Klopfensein의 최적 임피던스 Taper에 근거하여 설계한다. 또한, 10개로 구성된 단일 증폭기의 공간 결합 효율을 최대화 하기 위해 증폭 기간의 이득과 위상차를 각각 제어할 수 있는 CMOS 기반의 MFC(Multi-Function Core) MMIC와 10 W급 이상의 GaN 기반 종단 PA MMIC를 직접 개발하여 단일 증폭기에 내장하였다. 제작된 공간 결합 고출력 전력증폭기는 6~18 GHz의 거의 전대역에서 50 W 이상의 양호한 출력 특성을 보여준다.

Abstract AI-Helper 아이콘AI-Helper

This paper is a study of 6~18 GHz wideband high power amplifier which is composed of 10 single amplifier and coaxial type spatial power combiner. The property of this spatial power combiner is on a similar principle to antipodal antenna radiation mechanism. Therefore, the key structure of proposed s...

주제어

AI 본문요약
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문제 정의

  • 그림 1은 일반적인 Corporate 방식의 결합과 공간 결합 방식에 대한 개념도이다. 이에 본 논문에서는 6~18 GHz의 광대역에서 10개의 단일증폭기를 동축형 공간결합기로 결합한 50 W급 공간결합 전력증폭기를 개발하고, 그에 따른 공간결합 성능을 검증한다. 또한, 자체 개발한 이득/실시간 지연 제어소자 MFC(Multi-Function Chip) MMIC를 이용하여 각각의 단일 증폭기 사이의 위상 및 이득 차이를 최소화하여 공간 결합 효율을 최대화 하였다.

가설 설정

  • 단지 실제 제작한 동축형 공간 결합기의 최대 전달 손실은 그림 6에서 —2.6 dB이지만, 그림 9의 버짓에서는 추가적인 여유(Margin)를 고려하여 전달 손실을 —3.0 dB이라 가정하였다.
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질의응답

핵심어 질문 논문에서 추출한 답변
Corporate 방식의 근본적인 문제점을 해결하기 위해 다수개의 단일증폭기를 동시에 결합하는 이유는 무엇인가? 더욱이 Corporate 전력 결합 방식에 사용되는 윌키는 분배/결합기는 이론적으로 전송선의 1/4 파장을 기준으로 설계되어지는 소자이므로, 6~18 GHz의 3옥타브에 이르는 광대역에서는 특성 구현에 제한이 많으며, 다단으로 대역폭을 넓혔다고 하더라도 Corporate 방식의 근본적인 문제점은 해결할 수 없다. 그에 반해서 동축선이나 도파관과 같은 제한된 공간 내에서 광학 또는 안테나의 원리를 이용하여 다수개의 단일증폭기를 동시에 결합하는 공간 결합 방식은 위에서 설명한 Corporate 방식의 결합 문제를 극복할 수 있는 대안으로 제시된다. 그림 1은 일반적인 Corporate 방식의 결합과 공간 결합 방식에 대한 개념도이다.
고주파 대역에서 고출력의 전력을 발생하기 위해 사용된 기술은? 이제까지 고주파 대역에서 고출력의 전력을 위해서 클라이스트론, 마그네트론, 진행파관과 같은 진공관 형태의 단일 소자에 고전압전원공급기를 통해서 매우 높은 전압을 인가하는 기술을 이용하였다. 이러한 기술은 수 백 W에서 수 kW의 고출력을 발생시킬 수 있으나, 긴 예열시간, 5 % 이내의 짧은 듀티사이클, 짧은 수명, 수 kV 이상의 고전압전원공급기 및 저 신뢰성으로 송신기의 운영유지에 많은 대기시간과 비용을 차지하는 단점을 갖고 있다.
고주파 대역에서 고출력의 전력을 내기 위한 기술의 단점은 무엇인가? 이제까지 고주파 대역에서 고출력의 전력을 위해서 클라이스트론, 마그네트론, 진행파관과 같은 진공관 형태의 단일 소자에 고전압전원공급기를 통해서 매우 높은 전압을 인가하는 기술을 이용하였다. 이러한 기술은 수 백 W에서 수 kW의 고출력을 발생시킬 수 있으나, 긴 예열시간, 5 % 이내의 짧은 듀티사이클, 짧은 수명, 수 kV 이상의 고전압전원공급기 및 저 신뢰성으로 송신기의 운영유지에 많은 대기시간과 비용을 차지하는 단점을 갖고 있다. 따라서 최근에는 소형/경량의 고출력 전력증폭기를 위해서 다수개의 단일증폭기를 새로운 방식으로 결합하는 연구가 해외에서 활발하게 이루어지고 있다.
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참고문헌 (10)

  1. H. Javadi-Bakhsh, et al., "A wideband twenty-element microwave spatial power combiner", Scientia Iranica D, pp. 853-860, Mar. 2014. 

  2. Jia, P. "Broadband power combining device using antipodal nline structure", Capwireless Inc., U.S. Patent. 

  3. D. I. L. de Villiers, P. W. van der Walt, and P. Meyer, "Design of conical transmission line power combiners using tapered line matching sections", IEEE Trans. Microwave Theory Tech., vol. 56, no. 6, pp. 1478-1484, 2008. 

  4. K. Song, Y. Fan, and Z. He, "Broadband radial waveguide spatial combiner", IEEE Microwave and Wireless Component Letters, vol. 18, no. 2, pp. 73-75, 2008. 

  5. S. E. Hosseini, A. Banai, "Ultrabroadband power amplier using 16-way spatial combining line array", Wiley Microwave and Optical Technology Letters, vol. 55, no. 2, pp. 454-460, 2013. 

  6. N. S. Cheng, A. Alexanian, M. G. Case, D. B. Rensch, and R. A. York. "40-W CW broad-band spatial power combiner using dense finline arrays", IEEE Transactions on Microwave Theory and Techniques, vol. 47, no. 7, pp. 1070-1076, Jul. 1999. 

  7. A. Alexanian, R. A. York, "Broadband spatially combined amplifier array using tapered slot transitions in waveguide", IEEE Microwave and Guided Wave Letters, vol. 7, no. 2, pp. 42-44, Feb. 1997. 

  8. P. Jia, L. Y. Chen, A. Alexanian, and R. A. York, "Broadband high power amplifier using spatial power combining", IEEE Microwave Theory and Techniques Society, vol. 51, no. 12, pp. 2469-2475, Dec. 2003. 

  9. Behzad Razavi, "Design of analog CMOS integrated circuits", 2000. 

  10. Behzad Razavi, "RF microelectronics", 2011. 

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