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DRAM 커패시터의 질화막 내산화성 평가에 관한 연구
A Study on the Evaluation of Oxidation Resistance of Nitride Films in DRAM Capacitors 원문보기

한국전자통신학회 논문지 = The Journal of the Korea Institute of Electronic Communication Sciences, v.16 no.3, 2021년, pp.451 - 456  

정윤근 (전남대학교 기계설계공학부) ,  강성준 (전남대학교 전기및반도체공학과) ,  정양희 (전남대학교 전기및반도체공학과)

초록
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반도체 메모리 소자의 커패시터에서 셀 커패시턴스의 향상과 scale down을 위해 유전막으로써 적층형 ONO 구조가 도입되었고 이들의 박막화가 지속적으로 시도되고 있으나 공정 처리 과정에서 많은 문제들이 대두되고 있다. 본 연구에서는 L/L LPCVD를 사용하여 약 10Å의 자연산화막 성장을 억제함으로써 3fF/cell의 정전 용량을 확보할 수 있었다. 또한 유전막의 박막화에 따른 질화막의 이상산화에 미치는 영향을 고찰함으로써 내산화성을 확보할 수 있는 유전막 형성의 안정적인 공정 관리 방법을 제안하였다.

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In order to improve the cell capacitance and scale down in capacitors of semiconductor memory devices, a stacked ONO structure has been introduced as a dielectric layer and thinning of these layers has been attempted continuously. However, many problems have emerged in the manufacturing process. In ...

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참고문헌 (10)

  1. S. Mori, E. Sakagami, H. Araki, Y. Kaneko, K. Narita, Y. Ohshima, N. Aria, and K. Yoshikawa, "ONO inter-poly dielectric scaling for nonvolatile memory applications," IEEE Trans. on Electron Devices, vol. 38, no. 2, Feb. 1991, pp. 386-391. 

  2. S. Mun, S. Kang and Y. Joung, "A study on the DC parameter matching according to the shrink of 0.13㎛ technology," J. of the Korea Institute of Electronic Communication Science, vol. 9, no. 11, Nov. 2014, pp. 1227-1232. 

  3. S. Mun, S. Kang and Y. Joung, "A study on Flicker Noise Improvement by Decoupled Plasma Nitridation," J. of the Korea Institute of Electronic Communication Science, vol. 9, no. 7, July 2014, pp. 747-752. 

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  5. C. S. Pan, K. J. Wu, P. P. Freiberger, and G. Sery, "A scaling methodology for oxide-nitride-oxide interpoly dielectric for EPROM applications," IEEE Trans. Electron Devices, vol. 37, no. 6, June 1990, pp. 1439-1443. 

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  7. Y. Chung, S. Kang, and Y. Joung, "Analysis of process parameters on cell capacitances of memory devices,"J. of the Korea Institute of Electronic Communication Science, vol. 12, no. 5, Oct. 2017, pp. 791-796. 

  8. H. Kotaki, M. Nakano, Y. Takegawa, S. Kakimoto, Y. Mori, K. Mitsuhashi, J. Takagi, S. Tsuchimoto and Y. Akagi, "Novel Elevated Silicide Source / Drain by Load Lock LPCVD-Si and Advanced Silidation Processing," IEEE International Electron Device Meeting 93, Tokyo, Japan, Dec. 1993, pp. 839-842. 

  9. S. M. Sze, VLSI Technology. Singapore: McGraw-Hill, 2002. 

  10. W. Yoon, S. Kang, and Y. Joung, "Study on the trap parameter according to the nitridation conditions of the oxide films," J. of the Korea Institute of Electronic Communication Science, vol. 11, no. 5, May 2016, pp. 473-478. 

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