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NTIS 바로가기대한전기학회 2000년도 하계학술대회 논문집 D, 2000 July 17, 2000년, pp.3097 - 3099
오름 (고려대학교 전기공학과) , 김두곤 (고려대학교 전기공학과) , 우영신 (고려대학교 전기공학과) , 성만영 (고려대학교 전기공학과)
In this paper, we design PLL for a low jitter and fast locking time that is used a new simple precharged CMOS phase frequency detector(PFD). The proposed PFD has a simple structure with using only 18 transistors. Futhermore, the PFD has a dead zone 25ps in the phase characteristic which is important...
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