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효율적 자원제한 스케줄링 알고리즘
An Efficient Resource-constrained Scheduling Algorithm 원문보기

한국신호처리.시스템학회 2001년도 하계 학술대회 논문집(KISPS SUMMER CONFERENCE 2001, 2001 June 01, 2001년, pp.73 - 76  

송호정 (충북대학교 컴퓨터공학과) ,  정회균 (충북대학교 컴퓨터공학과) ,  황인재 (충북대학교 컴퓨터교육과) ,  송기용 (충북대학교 컴퓨터공학과)

초록
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High-level synthesis(HLS)는 주어진 동작(behavior)과 면적(area), 성능(performance), 전력 소비량, 패키징, 테스팅등의 주어진 제한을 만족하게 구현된 구조적 디자인을 생성한다. 즉 high-level synthesis란 디지털 시스템의 알고리즘 단계 서술로부터 레지스터 전달구조의 구현에 이르는 과정을 의미한다. 이러한 high-level synthesis의 과정은 컴파일, 분할(partitioning), 스케줄링(scheduling)등의 단계를 거쳐 디지털 시스템을 설계할 수 있다. 본 논문에서는 high-level synthesis의 단계 중 스케줄링 과정에서 제한조건이 실리콘 면적으로 주어지는 경우에 최적의 functional unit의 수를 찾아내어 최소의 control step에 효과적으로 스케줄링 가능한 알고리즘을 제안하였다.

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High-level synthesis generates a structural design that implements the given behavior and satisfies design constraints for area, performance, power consumption, packaging, testing and other criteria. Thus, high-level synthesis generates that register-transfer(RT) level structure from algorithm ...

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