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NTIS 바로가기한국철도학회 2011년도 정기총회 및 추계학술대회 논문집, 2011 Oct. 20, 2011년, pp.172 - 180
김도영 (삼성SDS) , 김현민 (삼성SDS) , 김윤배 (삼성SDS)
When it essentially designs and develops the Railway Signal System H/W and S/W, It requires base to build an environment which the safety of the complete system can be certified objectively. It is not rational choice to progress the safety certification of each of the subsystems to ensure reliabilit...
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핵심어 | 질문 | 논문에서 추출한 답변 |
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2 out of 3 H/W D-602 Board는 무엇을 가지는가? | 2 out of 3 H/W D-602 Board 는 독립된 3개의 CPU와 독립된 3개의 Memory Bank를 가진다. 각각의 CPU 와 Memory 는 Board Level에서 결과 값을 비교와 Voting을 하기 때문에 Application은 Virtual architectue 인 1개의 CPU 와 1개의 Memory Bank만을 인식하게 되고 Application 개발시에도 1개의 CPU 와 1개의 Memory Bank 만을 고려하면 된다. | |
Vital CPU Module는 무엇으로 구성되는가? | Vital CPU Module는 2 out of 3 구조의 CPU 보드를 Cluster로 구성한 Redundancy 시스템의 개념으로 구성된다. I/O 부는 Vital CPU Module과 표준 프로토콜을 이용하여 정보를 교환 한다. | |
SCADE에서 생성되는 Source Code는 어떤 특징이 있는가? | SCADE 는 Modeling 기반의 개발 툴로써 신호논리를 모델링하면 KCG에 의해 해당 모델에 대한 Source Code 가 생성 되는 구조이다. 이때 생성 되는 코드는 인증에 따른 제한 사항을 준수하며 Cycle 기방의 계산으로 1 Cycle 에 소스 내의 모든 코드가 실행되어지는 방식으로 실행되지 않기 때문에 오류가 발견되지 않는 경우를 방지 하여 오류를 방지한다. |
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