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Chip carrier alignment device and alignment method 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H05K-003/34
  • B23P-019/00
출원번호 US-0784406 (1985-10-04)
발명자 / 주소
  • Grassauer Willie K. (Mapleton OR)
출원인 / 주소
  • Raychem Corporation (Menlo Park CA 02)
인용정보 피인용 횟수 : 13  인용 특허 : 4

초록

A device and method for aligning and assembling castellated chip carriers with other electrical components such as printed circuit boards or other chip carriers is disclosed. The device provides means for compressively engaging the castellations in the chip carrier thereby providing precise alignmen

대표청구항

A device for aligning a castellated chip carrier comprising: a frame; engagement means operatively connected to said frame for compressively engaging at least one castellation in the opposite edges of a castellated chip carrier to be aligned; support means operatively connected to said frame to supp

이 특허에 인용된 특허 (4)

  1. Hug Paul (Santa Clara County CA), Alignment apparatus and method for mounting LSI and VLSI packages to a printed circuit board.
  2. Hall Peter M. (Emmaus PA) Howland Frank L. (Allentown PA) Morabito Joseph M. (Bethlehem PA) Rickabaugh Lawrence J. (North Andover MA), Fabrication of circuit packages.
  3. Guzik Andrzej T. (Ft. Lauderdale FL), Method of mounting interrelated components.
  4. Ellis ; Jr. Roland (Burlington Township ; Burlington County NJ) Jacobs Brian E. (Collingswood Township ; Camden County NJ) March Edward J. (Lower Makefield Township ; Bucks County PA) Newman Raymond , Technique for bonding a chip carrier to a metallized substrate.

이 특허를 인용한 특허 (13)

  1. Yoshino Thunekazu (Kamakura JPX) Morita Hiroshi (Kawasaki JPX) Nakano Hirotaka (Yokohama JPX) Hayashi Nobuo (Miura JPX) Kubota Yuko (Kamakura JPX), Bonding sheet for electronic component and method of bonding electronic component using the same.
  2. Dunaway Thomas J. (St. Louis Park MN) Speilberger Richard K. (Maple Grove MN) Loy Jerald M. (Anoka MN) Dicks Lori A. (New Hope MN) Balgaard Luverne O. (Burnsville MN), Controlled compression furnace bonding.
  3. Khandros Igor Y. ; Eldridge Benjamin N. ; Mathieu Gaetan L., Fabricating interconnects and tips using sacrificial substrates.
  4. Khandros Igor Y. ; Mathieu Gaetan L., Interconnection substrates with resilient contact structures on both sides.
  5. Buley, Todd H.; Lam, Roger; O'Connor, Daniel; Perry, Charles Hampton, Method of assembling a land grid array module.
  6. Castonguay Roger N. (Terryville CT) Palmieri Joseph M. (Southington CT) Scott Graham A. (Avon CT), Method of assembling a molded case circuit breaker current transformer assembly.
  7. Gerhard Benz DE; Jurgen Finze DE; Manfred Walker DE, Method of making a circuitized substrate assembly with carrier having substrates therein.
  8. Eldridge, Benjamin N.; Grube, Gary W.; Khandros, Igor Y.; Mathieu, Gaetan L., Microelectronic contact structure.
  9. Eldridge, Benjamin N.; Grube, Gary W.; Khandros, Igor Y.; Mathieu, Gaetan L., Microelectronic contact structure and method of making same.
  10. Lin Yai-Fen,TWX ; Liaw Shiou-Hann,TWX ; Kuo Di-Son,TWX ; Lee Jian-Hsing,TWX, Nonvolatile devices with P-channel EEPROM devices as injector.
  11. Dautartas Mindaugas Fernand, Passive alignment of components with micromachined tool.
  12. Eldridge, Benjamin N.; Grube, Gary W.; Khandros, Igor Y.; Mathieu, Gaetan L., Probe card assembly and kit, and methods of making same.
  13. Dozier ; II Thomas H. ; Khandros Igor Y., Solder preforms.
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