[보고서]1999년도대한전자공학회정기총회및추계종합학술대회 - EEPL을 사용한 저 전력 108-bit 조건합 가산기의 설계

조기선

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[국가R&D연구보고서] 1999년도대한전자공학회정기총회및추계종합학술대회 - EEPL을 사용한 저 전력 108-bit 조건합 가산기의 설계

보고서 정보
주관연구기관	정보통신연구진흥원 Institute for Information Technology Advancement
연구책임자	조기선
참여연구자	송민규
발행국가	대한민국
언어	한국어
발행년월	1999-11
등록번호	TRKO200500026380
DB 구축일자	2013-04-18

초록

본 논문의 순서는 다음과 같다. II장에서는 제안된 108-bit CSA의 전체 구조를 나타냈으며, III장에서는 제안하는 덧셈기의 세부 블록 회로 설계를 설명하였고, IV장에서는 시뮬레이션 결과를 논하였으며, 마지막으로 V장에서는 결론에 대해 기술하였다.

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