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NTIS 바로가기주관연구기관 | 광주과학기술원 Gwangju Institute of Science and Technology |
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연구책임자 | 이병훈 |
참여연구자 | 정종완 , 김경록 , 강석형 |
보고서유형 | 1단계보고서 |
발행국가 | 대한민국 |
언어 | 한국어 |
발행년월 | 2019-01 |
과제시작연도 | 2018 |
주관부처 | 과학기술정보통신부 Ministry of Science and ICT |
과제관리전문기관 | 한국연구재단 National Research Foundation of Korea |
등록번호 | TRKO201900020550 |
과제고유번호 | 1711070269 |
사업명 | 나노·소재기술개발(R&D) |
DB 구축일자 | 2020-04-25 |
키워드 | 다치로직.산술논리연산 장치.소모전력-지연시간 곱.삼진 인버터.삼진 최소/최대값 게이트.Multi valued logic.Arithmetic logic unit.Power-delay product.Ternary inverter.Ternary min/max gate. |
○ 삼진로직 시스템 동작을 검증하는 시뮬레이션 툴과 타이밍 분석 툴 최초 정립
○ 0.25 V 이상의 static noise margin을 가지는 삼진 단위 회로 최초 구현
○ 1V 이하에서 동작하는 삼진 ALU 시스템 최초 구현
○ 삼진 ALU 시스템을 통해 이진연산 시스템 대비 소모전력-지연시간 곱 (PDP: Power Delay Product)를 1/100로 절감한 초절전 연산 시스템 구현
(출처 : 보고서 요약서 3p)
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