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5nm이하급 반도체 공정에 적용되는 NH3/H2 gas 적용 원자층 식각 공정의 표면 안정성 연구 원문보기


안다원 (중앙대학교 대학원 융합공학과 나노공학전공 국내석사)

초록
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현재의 반도체 공정은 무어의 법칙에 따라 트랜지스터의 크기가 지속해서 감소하고 있으며 저전력, 고성능을 동시에 만족시킬 시스템 반도체를 요구하고 있다. 지속해서 감소하는 트랜지스터의 critical dimension 이 수십 nm 에서 수 nm 수준으로 접어들면서 이러한 공정 조건을 만족시키기 위한 차세대 증착, 식각 공정의 도입이 필수적이다. 이러한 관점에서 원자층 식각 공정은 수 nm 스케일의 패턴을 식각함과 동시에 표면 상태를 정밀하게 제어하여 디바이스의 구조와 성능에 영향을 미치지 않는 공정으로 큰 주목을 받고 있다. 또한 이렇게 작아진 크기의 ...

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In current semiconductor processes, the size of transistors is continuously decreasing according to Moore's Law, and system semiconductors that satisfy low power and high performance are required at the same time. As the continuously decreasing critical dimension of transistors approaches several nm...

주제어

#식각 원자층 제어 라만 표면 제어 

학위논문 정보

저자 안다원
학위수여기관 중앙대학교 대학원
학위구분 국내석사
학과 융합공학과 나노공학전공
지도교수 표성규
발행연도 2023
총페이지 v, 62 p.
키워드 식각 원자층 제어 라만 표면 제어
언어 kor
원문 URL http://www.riss.kr/link?id=T16832931&outLink=K
정보원 한국교육학술정보원
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