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[국내논문] Temperature-Adaptive Back-Bias Voltage Generator for an RCAT Pseudo SRAM 원문보기

ETRI journal, v.32 no.3, 2010년, pp.406 - 413  

Son, Jong-Pil (Memory Division, Samsung Electronics Corporation) ,  Byun, Hyun-Geun (Department of Semiconductor, SSIT, Samsung Electronics Corporation) ,  Jun, Young-Hyun (Memory Division, Samsung Electronics Corporation) ,  Kim, Ki-Nam (Memory Division, Samsung Electronics Corporation) ,  Kim, Soo-Won (Department of Electronics Engineering, Korea University)

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In order to guarantee the proper operation of a recessed channel array transistor (RCAT) pseudo SRAM, the back-bias voltage must be changed in response to changes in temperature. Due to cell drivability and leakage current, the obtainable back-bias range also changes with temperature. This paper pre...

Keyword

AI 본문요약
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제안 방법

  • This paper presents a pseudo SRAM for mobile applications with a simple temperature-adaptive VBB generator that guarantees the proper operation of the memory over the operating temperature range.
  • It is also required that the Vrout be changed to set the target VBB given from (4). The proposed scheme has a laser fusing method to tune the Vrout after the chip test.

이론/모형

  • In this paper, we used the long channel PMOSFET to give immunity from the short channel effect and process variations and Shockley’s MOSFET model is used for analysis instead of the alpha-power law model [12].
본문요약 정보가 도움이 되었나요?

참고문헌 (13)

  1. W.S. Lee et al., "Analysis on Data Retention Time of Nano-Scale DRAM and Its Prediction by Indirectly Probing the Tail Cell Leakage Current," IEDM Tech. Dig., 2004, pp. 395-398. 

  2. J.Y. Kim et al., "The Breakthrough in Data Retention Time of DRAM Using Recess-Channel-Array Transistor (RCAT) for 88 nm Feature Size and Beyond," Proc. Symp. VLSI Technol., Dig. Tech. Papers, 2003, pp. 11-12. 

  3. W.L. Martino et al., "An On-Chip Back-Bias Generator for MOS Dynamic memory," IEEE J. Solid-State Circuits, vol. 15, no. 5, Oct. 1980, pp. 820-826. 

  4. Y. Tsukikawa et al., "An Efficient Back-Bias Generator with Hybrid Pumping Circuit for 1.5-V DRAMs," IEEE J. Solid-State Circuits, vol. 29, Apr. 1994, pp. 534-538. 

  5. K.S. Min, "Efficient Back-Bias Voltage Generator with Suppressed Parasitic Bipolar Action for Low-Voltage DRAMs," Electron. Lett. vol. 37, no. 1, Jan. 2001, pp. 6-8. 

  6. D.S. Min et al., "Temperature-Compensation Circuit Techniques for High-Density CMOS DRAM's," IEEE J. Solid-State Circuits, vol. 27, no. 4, Apr. 1992, pp. 626-631. 

  7. Y.P. Kim et al., "Junction Leakage Current Degradation Under the Off-State Bias-Temperature Stress: A New Reliability Assessment Method for High-Density DRAMs," IEEE Trans. Device and Materials Reliability, vol. 1, Jun. 2001, pp. 104-108. 

  8. C.C. Wang, Y.L. Tseng, and C.C. Chiu, "A Temperature-Insensitive Self-Recharging Circuitry Used in DRAMs," IEEE Trans. VLSI Syst., vol. 13, Mar. 2005, pp. 405-408. 

  9. Y. Taur and T.H. Ning, Fundamentals of Modern VLSI Devices, Cambridge University Press, 1998. 

  10. S. Yoo et al., "Variable Vcc Design Techniques for Battery-Operated DRAM's," IEEE J. Solid-State Circuits, vol. 28, no. 4, Apr. 1993, pp. 499-503. 

  11. R.J. Baker, CMOS Circuit Design, Layout, and Simulation, 2nd ed., IEEE Press, 2005. 

  12. T. Sakurai and A.R. Newton, "Alpha-Power Law MOSFET Model and Its Applications to CMOS Inverter Delay and Other Formulas," IEEE J. Solid-State Circuits, vol. 25, no. 2, Apr. 1990, pp. 584-594. 

  13. I.M. Filanovsky and A. Allam, "Mutual Compensation of Mobility and Threshold Voltage Temperature Effects with Applications in CMOS Circuits," IEEE Trans. Circuits Syst. I, vol. 48, no. 7, Jul. 2001, pp. 876-884. 

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