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3차원 소자 적층을 위한 BOE 습식 식각에 따른 Cu-Cu 패턴 접합 특성 평가
Effect of BOE Wet Etching on Interfacial Characteristics of Cu-Cu Pattern Direct Bonds for 3D-IC Integrations 원문보기

大韓溶接·接合學會誌 = Journal of the Korean Welding and Joining Society, v.30 no.3, 2012년, pp.26 - 31  

박종명 (안동대학교 신소재공학부 청정에너지소재기술연구센터) ,  김수형 (서울테크노파크 MSP 기술지원센터) ,  김사라은경 (서울과학기술대학교 NID융합기술대학원) ,  박영배 (안동대학교 신소재공학부 청정에너지소재기술연구센터)

Abstract AI-Helper 아이콘AI-Helper

Three-dimensional integrated circuit (3D IC) technology has become increasingly important due to the demand for high system performance and functionality. We have evaluated the effect of Buffered oxide etch (BOE) on the interfacial bonding strength of Cu-Cu pattern direct bonding. X-ray photoelectro...

주제어

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제안 방법

  • 8 μm/min, 핀 간 거리는 5 mm로 하였다. 4점굽힘시험시 크랙이 진전되는 순간을 확인하기 위해 CCD 카메라를 이용하여 실시간으로 관찰하였다. 4점굽힘시험은 하나의 재료로 가정하고 재료 내부에 생긴 균열이 진전 할 때 필요한 에너지 해방률(G)을 선형파괴역학적 방법으로 측정하여 박막간 계면접합에너지를 측정하는 파괴역학 시험법이다15).
  • 4점굽힘시험이 완료된 시험편은 주사전자현미경 (Scanning Electron Microscope, SEM)을 이용하여 접합부의 미세구조를 관찰 하였다.
  • 8인치 실리콘 웨이퍼(725 μm)위에 SiO2를 700 nm 두께로 형성하고 Cu 폭이 30 μm와 간격이 각각 100, 300, 500 μm로 나누어진 마스크를 이용하여 패터닝을한 뒤 Ti를 30 nm 두께로 증착하였다.
  • Ti층 위에 Cu 700 nm를 DC 마그네트론 스퍼터로 증착 후 200 nm 두께의 Cu를 CMP 공정으로 제거하였다. CMP공정시 조건은 80 RPM으로 폴리싱 패드가 회전하면서 24 kPa의 압력으로 15초간 Cu를 CMP한 뒤 7초간 over 폴리싱을 진행하였다. 그리고 다른 하나의 웨이퍼는 700 nm 두께로 SiO2를 형성하고 Ti를 30 nm로 증착 한 뒤 1 μm의 두께로 Cu 박막을 증착하였다.
  • Cu-Cu 패턴 직접접합을 위해 다양한 패턴 밀도에 따른 효과를 Cu film/Cu pattern 열 압착 접합 후 Cu 접합부의 계면접합에너지를 4점굽힘시험법을 통해 정량적으로 평가하였다. Cu film/Cu pattern 열 압착 접합 전 BOE 습식 식각 후 Cu 표면 산화막이 일부 제거되는 것을 관찰하였다.
  • 식각된 Cu 표면 상태를 확인하기 위하여 X-ray Photoelectron Spectroscopy (XPS) 분석을 실시하였다. XPS분석은 Thermo Fisher Scientific, Multilab- 2000의 Al-Ka (1486.6 eV)을 X-ray 원으로 사용하였고, 이때 Binding energy scale은 Metallic Cu (932.6 eV), CuO(933.6 eV), Cu2O(931.7eV), Cu(OH)2(935.1eV) 을 기준으로 하였다13,14). 식각 공정이 완료된 두 장의 웨이퍼를 마주보도록 겹쳐 MicroTec SB8e 본더 장비로 이동 후 N2 가스 분위기에서 400℃의 온도와 25kN의 압력으로 60분간 Cu-Cu 열 압착 접합을 실시하였다.
  • 본 연구에서는 Cu-Cu 패턴의 직접 접합을 위해 Buffered Oxide Etch (BOE)용액으로 습식 식각 후 기존 Cu-Cu 접합 특성이 좋은 400℃ 접합 온도에서 Cu 패턴 밀도 변수에 따라 Cu-Cu 접합을 하였고, 4점굽힘시험법 (4-point bending test)을 이용하여 접합 특성을 평가하였다.
  • 1eV) 을 기준으로 하였다13,14). 식각 공정이 완료된 두 장의 웨이퍼를 마주보도록 겹쳐 MicroTec SB8e 본더 장비로 이동 후 N2 가스 분위기에서 400℃의 온도와 25kN의 압력으로 60분간 Cu-Cu 열 압착 접합을 실시하였다. 접합이 완료된 웨이퍼는 초음파 탐상 검사장비 (Scanning Acoustic Tomograph, SAT or SAM)을 사용하여 웨이퍼의 전체적인 접합 상태를 확인 후 4점굽힘시험법을 하기 위해 다이싱(dicing) 장비에서 다이아몬드 블레이드로 30 mm × 3 mm의 크기로 조각을 내었다.
  • 49% HF용액이 6:1비율로 만들어진 BOE용액으로 2분간 습식 식각 하였다. 식각된 Cu 표면 상태를 확인하기 위하여 X-ray Photoelectron Spectroscopy (XPS) 분석을 실시하였다. XPS분석은 Thermo Fisher Scientific, Multilab- 2000의 Al-Ka (1486.
  • 위와 아래에 4개에 핀의 중심에 고정된 시험편은 일정한 위쪽 두 개의 핀 사이에서 발생한 내부 균열을 통해 정량적인 계면접합에너지를 측정 할 수 있다. 실험은 압축모드, 변위제어로 실시하였으며, 결과는 하중과 변위곡선으로 나타난다. 여기서 재료 파괴 시 정상상태로 크랙이 전파되면서 생성되는 일정한 하중 영역을 보이는 구간의 하중 값을 아래의 유도된 식 1에 대입하여 정량적인 계면접합에너지를 얻을 수 있다16,17).
  • 접합 전 BOE 습식 식각 후 Cu 표면의 잔여물이나 산화막이 효과적으로 제거 되었는지 알아보기 위하여 XPS분석을 실시하여 표면에 와이드 픽 결과를 Fig. 2에 나타내었다. 습식 식각을 하지 않은 시험편과 BOE 습식 식각을 한 시험편 모두 와이드 픽에서 Si, C, O Cu가 검출되었고 BOE 2분 식각 후 표면의 C는 감소 하는 것을 확인 할 수 있었으나, O는 식각 후에도 변화를 관찰 할 수 없었다.
  • 접합이 완료된 웨이퍼는 초음파 탐상 검사장비 (Scanning Acoustic Tomograph, SAT or SAM)을 사용하여 웨이퍼의 전체적인 접합 상태를 확인 후 4점굽힘시험법을 하기 위해 다이싱(dicing) 장비에서 다이아몬드 블레이드로 30 mm × 3 mm의 크기로 조각을 내었다.

대상 데이터

  • Cu-Cu 열 압착 접합 방법으로 제작된 시험편은 R&B 사의 인장 시험기에 4점굽힘시험용 지그를 설치하여 정량적인 계면접합에너지를 측정되였다.
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질의응답

핵심어 질문 논문에서 추출한 답변
솔더 기반의 금속 접합의 문제점은? 3D 집적 적층을 하기 위해서 금속 접합, 산화물 접합, 혼합 접합 등 여러 가지 접합 방법들이 요구된다. 접합 방법 중 솔더 기반의 금속 접합은 비용이 저렴하고 공정이 간단하지만 취성이 강한 금속간화합물 (Intermetallic compound, IMC) 및 Kirkendall void의 형성으로 인해 기계적, 전기적 신뢰성이 감소되는 문제가 있다5-8). 반면에 Cu-Cu 직접 접합은 이러한 문제점을 해결하기 위한 대안으로 주목 받고 있지만 Cu 표면의 두꺼운 산화막이 생성되어 접합 시 상호 확산을 방해하는 문제점이 발생한다9-10).
TSV 기술은 어떤 방법인가? 3차원 집적회로를 달성하기 위해 몇 가지 핵심 기술은 Through Silicon Via (TSV), Chip/Wafer, Wafer/ Wafer 적층 접합 등이 있고, 이 같은 기술들이 완벽하게 이루어져야 한다1). TSV 기술은 실리콘 웨이퍼를 수십 마이크로미터 두께로 얇게 만든 칩에 직접 구멍을 뚫고 동일한 칩을 수직으로 적층하여 관통 전극으로 연결하는 3차원 System-in-Package (SiP) 방법으로, 기존의 패키지에 비해 제한된 면적 내에 많은 소자를만들고, 부피와 무게를 최소화 할 수 있으며, 고성능및 전력소모를 줄일 수 있는 장점이 있어 최근 활발히 연구 되고 있다2-4). 3D 집적 적층을 하기 위해서 금속 접합, 산화물 접합, 혼합 접합 등 여러 가지 접합 방법들이 요구된다.
Cu패턴으로 접합하는 경우 접합 후 후속 열처리를 하여도 본딩 계면에서 제대로 접합이 되지 않는 이유는? 또한 Cu패턴으로 접합할 경우 Chemical Mechanical Polishing (CMP)의 영향으로 Cu의 dishing 및 절연체의 erosion현상이 발생하게 된다. Cu dishing 및 erosion은 접합부의 접촉 면적을 줄이기 때문에 접합후 후속 열처리를 하여도 본딩 계면에서 제대로 접합이 되지 않는다고 보고된바 있다11). 이러한 문제를 해결하기 위해서 추가적인 공정이 필요하다.
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참고문헌 (19)

  1. Y.I. Kim et al., Thermal degradation of DRAM retention time : Characterization and improving techniques, In : IEEE 42nd IRPS Proc., (2004) 667-668 

  2. R.R. Tummala : Fundamentals of Microsystems Packaging, McGraw-Hill, New York (2001) 612-656 

  3. Y. Liu : Trends of power semiconductor wafer level packaging, Microelectronics Reliability 50 (2010) 514 

  4. H. Shimaamoto : Technical Trend of 3D Chip Stacked Previous Term MCP/SIP Next Term In, Proc. 57th Electronic Components and Technology Conference (ECTC), Nevada, IEEE Components, Packaging and Manufacturing technology Society (CPMT) (2007). 

  5. M.Y. Kim and T.S. Oh : Formation of Sn Through- Silicon-Via and Its Interconnection Process for Chip Stack Packages, Kor. J. Met. Mater., 48 (2010) 557 

  6. K. Tanida, M. Umemoto, N. Tanaka, Y. Tomita and K. Takahashi : Micro Cu Bump Interconnection on 3D Chip Stacking Technology, Jap. J. Appl. Phys., 43 (2004) 2264 

  7. B.H. Lee, J. Park, S.J. Jeon, K.W. Kwon and H.J. Lee : A Study on the Bonding Process of Cu Bump/ Sn/Cu Bump Bonding Structure for 3D Packaging Applications, J. Electrochem. Soc., 157 (2010) H420 

  8. Y.S. Lai, Y.T. Chiu and J. Chen : Electromigration Reliability and Morphologies of Cu Pillar Flip-Chip Solder Joints with Cu Substrate Pad Metallization, J. Electron. Mater., 37-10 (2008) 1624-1630 

  9. E.J. Jang, S.M. Hyun, H.J. Lee and Y.B. Park : Effect of Wet Pretreatment on Interfacial Adhesion Energy of Cu-Cu Thermocompression Bond for 3D IC Packages, J. Electron. Mat., 38, 12 (2009) 2449-2454 

  10. E.J. Jang, J.W. Kim, B. Kim, T. Matthias, H.J Lee, S. Hyun and Y.B. Park : Effect of N2+H2 Forming Gas Annealing on the Interfacial Bonding Strength of Cu-Cu thermo-compression Bonded Interfaces, J. Microelectron. Packag. Soc., 16-3, 1 (2009) 31-37 

  11. P. Gueguen, C. Ventosa, L.D. Cioccio, H. Moriceau, F. Grossi, M. Rivoire, P. Leduc and L. Clavelier : Physics of direct bonding: Applications to 3D heterogeneous or monolithic integration, Microelectronic Engineering, 87-3 (2010) 477-484 

  12. J.M. Park, Y.R Kim, S.D. Kim, J.W. Kim, Y.B. Park : Wet Etching Characteristics of Cu Surface for Cu-Cu Pattern Direct Bonds, J. Microelectron. Packag. Soc., 19-1 (2012) 39-45 

  13. S.L. Hulbert, B.A. Bunker and F.C. Brown : Copper $L_{2,3}$ near-edge structure in $Cu_{2}O$ , The American Physical society, 30-4 (1984) 2120-2126 

  14. C.D. Wagner, W.M. Riggs, L.E. Davis and J.F. Moulder : Handbook of X-ray Photoelectron Spectroscopy, Perkin-Elmer Corporation, Eden Prairie, MN, U. S. A., (1978) 82-83 

  15. R.H. Dauskardt, M. Lane, Q. Ma and N. Krishna : Adhesion and debonding of multi-layer thin film structures, Eng Fract Mech., 61-1 (1998) 141-162 

  16. P.G. Charalambides, J. Lund, A.G. Evans and R.M. McMeeking : A test specimen for determining the fracture resistance of bimaterial interfaces, J. Appl. Mech., 111 (1989) 77 

  17. J.W. Kim, K.S. Kim, H.J. Lee, H.Y Kim, Y.B. Park and S. Hyun : The effect of plasma precleaning on the Cu-Cu direct bonding for 3D chip stacking, proc. 18th IEEE IPFA, Korea, (2011) 102-105 

  18. R. Tadepalli : Characterization and Requirements for Cu-Cu Bonds for Three-Dimensional Integrated Circuits, Massachusetts Institute of Technology, (2007) 63-64 

  19. T. Scherban, B. Sun, J. Blaine, C. Block, B. Jin, E. Andideh : Interfacial Adhesion of Copper-Low k Interconnects, Proceedings of the International Interconnect Technology Conference, (2001) 257-259 

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