$\require{mediawiki-texvc}$

연합인증

연합인증 가입 기관의 연구자들은 소속기관의 인증정보(ID와 암호)를 이용해 다른 대학, 연구기관, 서비스 공급자의 다양한 온라인 자원과 연구 데이터를 이용할 수 있습니다.

이는 여행자가 자국에서 발행 받은 여권으로 세계 각국을 자유롭게 여행할 수 있는 것과 같습니다.

연합인증으로 이용이 가능한 서비스는 NTIS, DataON, Edison, Kafe, Webinar 등이 있습니다.

한번의 인증절차만으로 연합인증 가입 서비스에 추가 로그인 없이 이용이 가능합니다.

다만, 연합인증을 위해서는 최초 1회만 인증 절차가 필요합니다. (회원이 아닐 경우 회원 가입이 필요합니다.)

연합인증 절차는 다음과 같습니다.

최초이용시에는
ScienceON에 로그인 → 연합인증 서비스 접속 → 로그인 (본인 확인 또는 회원가입) → 서비스 이용

그 이후에는
ScienceON 로그인 → 연합인증 서비스 접속 → 서비스 이용

연합인증을 활용하시면 KISTI가 제공하는 다양한 서비스를 편리하게 이용하실 수 있습니다.

Backward Pegging을 이용한 반도체 후공정 스케줄링
Semiconductor Backend Scheduling Using the Backward Pegging 원문보기

한국CAD/CAM학회논문집 = Transactions of the Society of CAD/CAM Engineers, v.19 no.4, 2014년, pp.402 - 409  

안의국 (아주대학교 산업공학과) ,  서정철 (삼성전자) ,  박상철 (아주대학교 산업공학과)

Abstract AI-Helper 아이콘AI-Helper

Presented in this paper is a scheduling method for semiconductor backend process considering the backward pegging. It is known that the pegging for frontend is a process of labeling WIP lots for target order which is specified by due date, quantity, and product specifications including customer info...

주제어

AI 본문요약
AI-Helper 아이콘 AI-Helper

* AI 자동 식별 결과로 적합하지 않은 문장이 있을 수 있으니, 이용에 유의하시기 바랍니다.

문제 정의

  • 본 연구는 반도체 후공정에 특성을 반영해 최종납기일까지 목표수량을 만족시키는 스케줄링 수립을 위한 방안을 제안했다. 이를 위해 반도체 후공정에 특징을 소개했고, 반도체 후공정 스케줄링을 위한 B/W Pegging 방안을 제안했다.
  • 하지만 전공정 분야에 비해 후공정 부분에 대한 연구는 부족한 것이 현실이다. 본 연구는 반도체 후공정에서의 스케줄링 수립 방안을 제시한다. 이를 위해 반도체 후공정을 소개하고, 후공정의 특징을 고려한 B/W(Backward) Pegging 방안을 제시했다.
  • 전공정은 여러 세부 공정으로 구성된 레이어 공정이 20~30개씩 반복되어 작업되기 때문에 여러 개의 칩이 적층되는 MCP(Multi Chip Package) 제품을 가지며 공정의 진행에 따라 제품의 종류가 변경 가능한 반도체 후공정의 생산 방식과 차이가 있기 때문에 기존의 Pegging 방식을 후공정에 적용하기는 어렵다. 본 연구는 후공정의 특성을 고려한 Pegging 방안을 제안한다. 제품 별로 목표 수량, 납기일을 고려해 B/W Pegging을 수행하는데 패키지 공정의 경우 MCP의 완성 칩의 수량을 고려한 Pegging을 하며, 테스트 공정의 경우 Binning 과정에서 제품의 종류가 결정되기 때문에 테스트 공정의 중간에 있는 재공에 대해 F/W(Forward) Pegging 전개를 수행한다.
본문요약 정보가 도움이 되었나요?

질의응답

핵심어 질문 논문에서 추출한 답변
라미네이션 공정은 무엇인가? 라미네이션(Lamination) 공정은 이물질로부터 웨이퍼를 보호하기 위해 보호 테이프를 웨이퍼에 붙이는 공정이고, 백그라인딩(Back Grinding) 공정은 웨이퍼 뒷면의 불필요한 막을 제거하는 공정으로, 두꺼운 뒷면을 깎아 저항을 줄이고 열전도율의 향상하는 공정으로 전자기기의 소형, 박형, 경량화를 위해 필요하다. 웨이퍼 절단(Sawing)은 반도체 전공정에서 만들어진 웨이퍼를 절단하여 개개의 칩으로분리하는 공정이다.
반도체 제조는 어떤 공정으로 나뉘는가? 반도체 제조는 크게 전공정과 후공정으로 나뉘어 진다. 300개 이상의 단위 공정으로 구성된 전 공정은 절연체와 비 절연체의 패턴을 가공함으로써 웨이퍼 전자회로를 만들어간다[25].
반도체 제조 과정 중 후공정은 어떻게 구분되는가? 300개 이상의 단위 공정으로 구성된 전 공정은 절연체와 비 절연체의 패턴을 가공함으로써 웨이퍼 전자회로를 만들어간다[25]. 후공정은 웨이퍼가 완성된 이후 반도체 칩을 탑재될 기기에 적합한 형태로 만드는 공정을 의미하며 웨이퍼를 자르고 조립한 이후 테스트하고 출하하는 방식으로 진행된다. 후공정은 다시 칩을 조립하는 패키지 공정과 조립된 칩을 테스트하는 패키지 테스트공정으로 구분된다. 후공정 중 패키지 공정의 세부작업은 Fig.
질의응답 정보가 도움이 되었나요?

참고문헌 (28)

  1. Lee, Y.H., Cho, H.M., Park, J.K. and Lee, B.K., 1999, Scheduling Simulator for Semiconductor Fabrication Line, IE Interface, 12(3), pp.437-447. 

  2. http://www.ksia.or.kr/renewal/bbs/bbsView.jsp 

  3. Kim, Y.-H., Lee, J.-H. and Sun, D.S., 2008, The Operational Optimization of Semiconductor Research and Development Fabs by FAB-wide Scheduling, KIEE International Transactions on Electrical Machinery and Energy Conversion Systems, 57(4), pp.692-699. 

  4. Park, D., Yang, J., You, K. and Park, B., Implementation of an E-BOM Copy Method for an Order-specific Semiconductor Equipment, Transactions of the Society of CAD/CAM Engineers, 13(4), pp.273-285. 

  5. Lim, S.K., Kim, J.G. and Kang, J.G., 2009, A Collaboration System for Two-stage Semiconductor Manufacturing Supply Chain, Journal of the Korea Management Engineers Society, 14(2), pp.11-29. 

  6. Uzsoy, R., Lee, C.Y. and Martin-vega, A.L., 1994, A Review of Production Planning and Scheduling Models in the Semiconductor Industry Part1: System Characteristics, Performance Evaluation and Production Planning, IIE Transactions, 24(4), pp.47-60. 

  7. Lee, Y.-H., Kim, S.-Y., Lee, G.-W. and Lee, S.-W., 1995, Production Planning and Control in Semiconductor Industry:Theory and Practice, IE Interfaces, 8(4), pp.73-87. 

  8. Lee, Y.-H. and Joung, H.-G., 1990, Development of Seimulator for Efficient Control of Semiconductor Manufacturing Process, International Journal of Production Research, 28(9), pp.1595-1609. 

  9. Bang, J.-Y. and Kim, Y.-D., 2011, Scheduling Algorithms for a Semiconductor Probing Facility, Computers & Operations Research, 38(3), pp.666-673. 

  10. Choi, S.-W., 2012, Scheduling Algorithms for Minimizing Total Weighted Flowtime in Photolithography Workstation of FAB, Journal of the Society of Korea Industrial and Systems Engineering, 35(1), pp.79-86. 

  11. Quek, P.T., Gan, B.P., Tan, S.L. and Peng, C.L. 2007, Analysis of the Frontend Wet Strip Efficiency Performance for Productivity. In Proceedings of International Symposium on Semiconductor Manufacturing, ISSM 2007, pp.1-4. 

  12. Park, Y.-J., 2008, Minimization of Total Weighted Earliness and Tardiness on a Single Burn-In Oven Using a Genetic Algorithm, Journal of the Society of Korea Industrial and System Engineering, 31(4), pp.21-28. 

  13. Park, S.C., Kim, B.H., Seo, J.C., Ahn, E., Chung, Y. and Yang, K.-R., 2013, Fab Simulation with Recipe Arrangement of Tools, Proceedings of the 2013 Winter Simulation Conference. 

  14. Rose, O., 2003, Comparison of Due-date Oriented Dispatch Rules in Semiconductor Manufacturing, In Proceeding of the 2003 Industrial Engineering Research Conference. 

  15. Zhou, Z. and Rose, O. 2011. A Composite Rule Combining Due Date Control and WIP Balance in a Wafer FAB. In Proceedings of the 2011 Winter Simulation Conference. 

  16. GiBrau Mike and Rose, O., 2012, Development and Introduction of a Combined Dispatching Policy at a High-mix Low-volume ASIC Facility, Proceedings of the 2012 Winter Simulation Conference. 

  17. Zhou, Z. and Rose, O. 2012. WIP Control and Calibration in a Wafer FAB. In Proceedings of the 2012 Winter Simulation Conference. 

  18. Sivakumar, A.I. and Chong, C.S., 2001, A Simulation Based Analysis of Cycle Time Distribution, and Throughput in Semiconductor Backend Manufacturing, Computers in Industry, 45, pp.59-78. 

  19. Chai, J.I., 2008, A Case Study on the Throughput Improvement in the Semiconductor Package Process, Kyung Hee University, Master Degree Thesis. 

  20. Quadt, D., Simulation-based Scheduling of Parallel Wire-bonders with Limited Clamp&paddles, Proceedings of the 2006 Winter Simulation Conference. 

  21. Tovia, F., Mason, S.J. and Ramasami, B., 2004, A Scheduling Heuristic for Maximizing Wirebonder Thoughput, IEEE Transactions on Electronics Packaging Manufacturing, 27(2). 

  22. Jang, S.H., Whang, W.K., Park, S.K., Koh, R.B., Koo, Y.M. and Woo, K.B., 1999 Petri Nets Modeling and Dynamic Scheduling for the Backend Line in Semiconductor Manufacturing, International Journal of Control Robotics and Systems, 5(6), pp.724-733. 

  23. Hsu, H.P. and Su, C.T., 2005, The Implementation of an Activity-based Costing Collaborative Planning System for Semiconductor Backend Product, International Journal of Production Research, 43(12), pp.2473-2492. 

  24. Weigert, G., Klemmt, A. and Horn, S., 2009, Design and Validation of Heuristic Algorithms for Simulation-based Scheduling of a Semiconductor Backend Facility, International Journal of Production Research, 47(8), pp.2165-2184. 

  25. Lu, S.C.H., Ramaswamy, D. and Kumar, P.R., 1998, Efficient Scheduling Policies to Reduce Mean and Variance of Flow-Time in Semiconductor Manufacturing Plants, IEEE Transactions on Semiconductor Manufacturing, 7(3), pp.115-130. 

  26. Liu, C., 1992, A Modular Production Planning System for Semiconductor Manufacturing, Ph.D. Dissertation, University of California, Berkeley. 

  27. Ko, K., Park, B.C., Yoo, S.K., Park, E.S. and Kim, B.H., 2010, Simulation based FAB Scheduling: SEEPLAN(R). In Proceedings of the 2010 Winter Simulation Conference. 

  28. Do, Y.Y., 2013, An Experimental Research on Production rate Improvement of Die Attach Process in Semiconductor Package Manufacturing, Ph.D. Dissertation, Myongji University. 

저자의 다른 논문 :

LOADING...

관련 콘텐츠

오픈액세스(OA) 유형

BRONZE

출판사/학술단체 등이 한시적으로 특별한 프로모션 또는 일정기간 경과 후 접근을 허용하여, 출판사/학술단체 등의 사이트에서 이용 가능한 논문

이 논문과 함께 이용한 콘텐츠

저작권 관리 안내
섹션별 컨텐츠 바로가기

AI-Helper ※ AI-Helper는 오픈소스 모델을 사용합니다.

AI-Helper 아이콘
AI-Helper
안녕하세요, AI-Helper입니다. 좌측 "선택된 텍스트"에서 텍스트를 선택하여 요약, 번역, 용어설명을 실행하세요.
※ AI-Helper는 부적절한 답변을 할 수 있습니다.

선택된 텍스트

맨위로