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NTIS 바로가기마이크로전자 및 패키징 학회지 = Journal of the Microelectronics and Packaging Society, v.22 no.2, 2015년, pp.61 - 68
박동현 (홍익대학교 공과대학 신소재공학과) , 신수진 (홍익대학교 공과대학 신소재공학과) , 안석근 (앰코코리아 기술연구소) , 오태성 (홍익대학교 공과대학 신소재공학과)
Warpage analysis has been performed for top and bottom packages of thin package-on-packages processed with different epoxy molding compounds (EMCs). Warpage deviation was measured for packages molded with the same EMCs and also the warpage deviations of top and bottom substrates themselves were char...
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핵심어 | 질문 | 논문에서 추출한 답변 |
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PoP 기술의 장점은? | 이를 해결하기 위한 반도체소자들의 고집적화 방안으로써, 기존의 반도체 칩들을 삼차원으로 적층하여 집적화하는 Through-Si-Via (TSV), System-in-Package (SiP), Package on Package(PoP)와 같은 적층 패키징 기술들이 활발히 개발되고 있다.1-4) 이들 삼차원 패키징 기술중에서 PoP 기술은 상부 패키지와 하부 패키지를 개별적으로 적층하여 조합하는 것이 가능하기 때문에, bare 칩들을 적층하여 일체화 하는 TSV 기술에 비해 저비용으로 다양한 기능의 소자를 구현할 수 있는 장점이 있다.2-5) 또한 제조공정에서 상부와 하부의 개별 패키지들을 미리 테스트하여 Known Good Die (KGD) 패키지들을 미리 선별하여 사용하는 것이 가능하므로 최종 패키지 제품의 수율을 높일 수 있는 장점이 있다. | |
Warpage느 어떤 문제를 발생시키는가? | PoP는 기판, 칩, epoxy molding compound (EMC) 등과같이 여러 재료들의 접합으로 이루어지게 되는데 이때 각 재료의 열팽창계수 차이에 기인한 열응력이 발생하며,3)이에 의해 PoP 패키지에 warpage가 발생하게 된다. Warpage는 PoP 상부 패키지와 하부 패키지의 솔더 접속 부에서 open joint 불량을 발생시키며 마더보드와 PoP 패키지 사이의 솔더 접속공정에서도 접속 불량을 일으키는 가장 큰 원인이 된다.9) 또한 warpage에 의해 상부와 하부패키지 및 마더보드 사이의 솔더 접속부에 지속적인 응력이 작용하게 되어 제품의 장시간 신뢰성이 저하되는 원인이 된다.10) | |
모바일 기기에서 반도체 소자들의 면적 문제점을 해결하기 위한 방안은? | 모바일 기기에서는 휴대성이라는 특수성 때문에 사용되는 반도체 소자들의 면적이 다른 전자기기들에 비해 크게 제한받게 된다. 이를 해결하기 위한 반도체소자들의 고집적화 방안으로써, 기존의 반도체 칩들을 삼차원으로 적층하여 집적화하는 Through-Si-Via (TSV), System-in-Package (SiP), Package on Package(PoP)와 같은 적층 패키징 기술들이 활발히 개발되고 있다.1-4) 이들 삼차원 패키징 기술중에서 PoP 기술은 상부 패키지와 하부 패키지를 개별적으로 적층하여 조합하는 것이 가능하기 때문에, bare 칩들을 적층하여 일체화 하는 TSV 기술에 비해 저비용으로 다양한 기능의 소자를 구현할 수 있는 장점이 있다. |
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오픈액세스 학술지에 출판된 논문
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