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3D패키지용 Via 구리충전 시 전류밀도와 유기첨가제의 영향
Effects of Current Density and Organic Additives on via Copper Electroplating for 3D Packaging 원문보기

한국재료학회지 = Korean journal of materials research, v.22 no.7, 2012년, pp.374 - 378  

최은혜 (한밭대학교 정보통신공학과) ,  이연승 (한밭대학교 정보통신공학과) ,  나사균 (한밭대학교 재료공학과)

Abstract AI-Helper 아이콘AI-Helper

In an effort to overcome the problems which arise when fabricating high-aspect-ratio TSV(through silicon via), we performed experiments involving the void-free Cu filling of a TSV(10~20 ${\mu}m$ in diameter with an aspect ratio of 5~7) by controlling the plating DC current density and the...

주제어

AI 본문요약
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문제 정의

  • 따라서 본 논문에서는 전기도금법을 이용하여 전류밀도 세기에 따른 via filling 특성을 확인하고, 유기첨가제 중가속제(SPS)의 첨가량 변화가 via filling에 미치는 영향을 분석하였다.

가설 설정

  • 2) 와이어 본딩 방식은 외부의 와이어에 의하여 신호가 전달된다. 일반적으로, 와이어의 길이가 길기 때문에 저항이 높아지고, 전류의 손실이 높아져 결국 주파수특성이 나빠지게 된다.
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질의응답

핵심어 질문 논문에서 추출한 답변
TSV의 장점은 무엇인가? TSV란 실리콘 내부에 via를 형성하여 소자와 소자, 소자와 기판 사이에 신호 전달 통로로 사용하는 기술로써, via가 소자의 열 방출 통로로 작용함으로써 패키지 온도 상승을 효과적으로 줄일 수 있는 장점이 있다.2) 와이어 본딩 방식은 외부의 와이어에 의하여 신호가 전달된다.
TSV란 무엇인가? TSV란 실리콘 내부에 via를 형성하여 소자와 소자, 소자와 기판 사이에 신호 전달 통로로 사용하는 기술로써, via가 소자의 열 방출 통로로 작용함으로써 패키지 온도 상승을 효과적으로 줄일 수 있는 장점이 있다.2) 와이어 본딩 방식은 외부의 와이어에 의하여 신호가 전달된다.
TSV기술 중 via 내부를 채우는 전도성 filling 물질로 주로 사용되는 것은 무엇인가? TSV기술을 이용하여 특성을 최대화하기 위해서는 via내부를 결함 없이 충진 (filling) 물질로 채우는 것이 중요하다. Via 내부를 채우는 전도성 filling 물질로써, 전기전도도와 도금특성이 우수한 물질인 구리가 주로 사용되고 있다.3)
질의응답 정보가 도움이 되었나요?

참고문헌 (13)

  1. K. Kondo, T. Yonezawa, D. Mikami, T. Okubo, Y. Taguchi, K. Takahashi and D. P. Barkey, J. Electrochem. Soc., 152(11), H173 (2005). 

  2. Y. Yang, R. Labie, F. Ling, C. Zhao, A. Radisic , J. Van Olmen, Y. Travaly, B. Verlinden and I. De Wolf, Microelectron. Reliab., 50, 1636 (2010). 

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  4. Z. Wang, O. Yaegashi, H. Sakaue, T. Takahagi and S. Shingubara, J. Electrochem. Soc., 151(12), C781 (2004). 

  5. A. Radisic, O. Luhn, H. G. G. Philipsen, Z. El-Mekki, M. Honore, S. Rodet, S. Armini, C. Drijbooms, H. Bender and W. Ruythooren, Microelectronic Eng., 88, 701 (2011). 

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  7. Y. Song, J. -H. Seo, Y. -S. Lee, S. -K. Rha, Kor. J. Mater, Res., 19(6), 334 (2009) (in Korean). 

  8. T. -G. Woo, I. -S. Park, H. -W. Lee and K. -W. Seol, Kor. J. Mater, Res., 16(11), 710 (2006) (in Korean). 

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  10. W. -P. Dow, C. -C. Li, Y. -C. Su, S. -P. Shen, C. -C. Huang, C. Lee, B. Hsu and S. Hsu, Electrochim. Acta, 54, 5894 (2009). 

  11. J. W. Gallaway, M. J. Willey and A. C. West, J. Electrochem. Soc., 156(8), D287(2009). 

  12. S. S. Noh, E. H. Choi, Y. H. Lee, H. J. Ju, S. K. Rha, B. J. Lee, D. K. Kim and Y. S. Lee, in Proceedings of the 18th IEEE International Symposium on the Physical and Failure Analysis of Integrated Circuits(Incheon, Korea, July, 2011) p. 305. 

  13. G. -H. Chang and J. -H. Lee, J. Microelectron. Packag. Soc., 13(4), 45 (2006). 

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