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NTIS 바로가기국가/구분 | 한국(KR)/공개특허 |
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국제특허분류(IPC9판) |
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출원번호 | 10-2008-0129839 (2008-12-19) |
공개번호 | 10-2010-0071206 (2010-06-29) |
DOI | http://doi.org/10.8080/1020080129839 |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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심사진행상태 | 취하(심사미청구) |
법적상태 | 취하 |
본 발명은 반도체 소자의 MIM 커패시터 형성 기술에 관한 것으로, 본 발명은 MIM 구조의 커패시터 형성 및 후속 메탈 층의 형성을 하나의 공정으로 제조하기 위하여 하부 금속 배선 영역에 홀을 형성하고, 형성된 홀에 하부 금속 층, 절연막과 상부 금속층을 순차적으로 형성하여 MIM 구조를 형성하게 되며, 이러한 MIM 구조의 형성 시 사용되는 포토레지스트로 패턴을 형성하는 경우, MIM 구조와 메탈층 형성을 위한 패턴을 동시에 형성하게 되므로, 이러한 포토레지스트 패턴을 마스크로 하여 식각 공정을 수행하는 경우, MIM 구조와 메
반도체 기판 상에 형성된 하부 금속 배선과,상기 하부 금속 배선이 형성된 상기 반도체 기판의 전면에 형성된 산화막과, 상기 산화막에서 상기 하부 금속 배선 영역으로 형성된 홀에 갭필된 하부 금속층과, 상기 하부 금속층이 기 설정된 깊이까지 식각되어 상기 식각된 하부 금속층 영역에 형성된 절연막과, 상기 절연막 상에 형성된 상부 금속층을 포함하는 반도체 소자의 MIM 커패시터.
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